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参数资料
| 型号： | AD9520-5BCPZ-REEL7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 15/76页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN EXT VCO 64LFCSP |
| 设计资源： | Synchronizing Multiple AD9910 1 GSPS Direct Digital Synthesizers (CN0121) Phase Coherent FSK Modulator (CN0186) |
| 标准包装： | 750 |
| 类型： | 时钟发生器，扇出配送 |
| PLL： | 是 |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:12，2:24 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 2.4GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 64-LFCSP-VQ（9x9） |
| 包装： | 带卷 (TR) |
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AD9520-5
Data Sheet
Rev. A | Page 22 of 76
Figure 18. CMOS Output Swing vs. Frequency and Capacitive Load
Figure 19. Additive (Residual) Phase Noise, CLK-to-LVPECL at 245.76 MHz,
Divide-by-1
Figure 20. Additive (Residual) Phase Noise, CLK-to-LVPECL at 1600 MHz,
Divide-by-1
Figure 21. Additive (Residual) Phase Noise, CLK-to-LVPECL at
200 MHz, Divide-by-5
4.0
3.5
3.0
2.5
2.0
1.5
1.0
0.5
0
700
2pF
10pF
20pF
600
500
400
300
200
100
A
MPL
IT
U
D
E
(V)
FREQUENCY (MHz)
07239-
124
–100
–110
–120
–130
–140
–150
–160
10
1k
100
100M
1M
10M
100k
10k
PH
A
SE
N
O
ISE
(d
B
c
/H
z)
FREQUENCY (Hz)
07239-
128
–100
–110
–120
–130
–140
–150
–160
10
1k
100
100M
1M
10M
100k
10k
PH
A
SE
N
O
ISE
(d
B
c
/H
z)
FREQUENCY (Hz)
07239-
130
–100
–110
–120
–130
–140
–150
–160
10
1k
100
100M
1M
10M
100k
10k
PH
A
SE
N
O
ISE
(d
B
c
/H
z)
FREQUENCY (Hz)
07239-
129
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PDF描述 |
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参数描述 |
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