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参数资料
| 型号： | AD9522-1BCPZ-REEL7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 26/84页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN 2.5GHZ VCO 64LFCSP |
| 标准包装： | 750 |
| 类型： | 时钟发生器，扇出配送 |
| PLL： | 是 |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，LVDS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:12，2:24 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 2.65GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 64-LFCSP-VQ（9x9） |
| 包装： | 带卷 (TR) |
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AD9522-1
Rev. 0 | Page 32 of 84
PROGRAMMABLE
N DELAY
REFIN
CLK
REF1
REF2
BUF
AMP
AD9522
R
DI
V
ID
E
R
CL
O
CK
DO
UBL
E
R
STATUS
PR
O
G
R
A
MM
A
B
L
E
R
DE
L
AY
REFERENCE
SWITCHOVER
REF_SEL
CPRSET VCP
VS
GND
RSET
DISTRIBUTION
REFERENCE
REFMON
CP
STATUS
LD
P, P + 1
PRESCALER
A/B
COUNTERS
N DIVIDER
BYPASS
LF
LOW DROPOUT
REGULATOR (LDO)
PHASE
FREQUENCY
DETECTOR
LOCK
DETECT
CHARGE
PUMP
PL
L
RE
F
E
RE
NCE
HOLD
0
1
DIVIDE BY 1,
2, 3, 4, 5, OR 6
PD
SYNC
REFIN
RESET
EEPROM
DIGITAL
LOGIC
EEPROM
DIVIDE BY
1 TO 32
OUT0
OUT1
OUT2
DIVIDE BY
1 TO 32
OUT3
OUT4
OUT5
DIVIDE BY
1 TO 32
OUT6
OUT7
OUT8
DIVIDE BY
1 TO 32
OUT9
OUT10
OUT11
ZERO DELAY BLOCK
L
V
DS
/CM
O
S
O
UT
P
UT
S
STATUS
SP1
SP0
SPI
INTERFACE
I2C
INTERFACE
SCLK/SCL
SDIO/SDA
SDO
CS
SERIAL
PORT
DECODE
OPTIONAL
07
22
0-
0
29
Figure 39. High Frequency Clock Distribution—CLK or External VCO > 1600 MHz (Mode 2)
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PDF描述 |
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