参数资料
型号: AD9540BCPZ
厂商: Analog Devices Inc
文件页数: 27/32页
文件大小: 0K
描述: IC CLOCK GENERATOR PLL 48-LFCSP
标准包装: 1
类型: 时钟发生器
PLL:
输入: 时钟
输出: CML,PECL
电路数: 1
比率 - 输入:输出: 2:2
差分 - 输入:输出: 是/是
频率 - 最大: 655MHz
除法器/乘法器: 是/无
电源电压: 1.71 V ~ 1.89 V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 48-VFQFN 裸露焊盘,CSP
供应商设备封装: 48-LFCSP-VQ(7x7)
包装: 托盘
产品目录页面: 776 (CN2011-ZH PDF)
AD9540
Rev. A | Page 4 of 32
SPECIFICATIONS
AVDD = DVDD = 1.8 V ± 5%; DVDD_I/O = CP_VDD = 3.3 V ± 5% (@ TA = 25°C), DAC_RSET = 3.92 k, CP_RSET = 3.09 k,
DRV_RSET = 4.02 k, unless otherwise noted.
Table 1.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
TOTAL SYSTEM JITTER AND PHASE NOISE FOR
105 MHz ADC CLOCK GENERATION CIRCUIT
Converter Limiting Jitter1
720
fS rms
Resultant Signal-to-Noise Ratio (SNR)
59.07
dB
Phase Noise of Fundamental
@ 10 Hz Offset
80
dBc/Hz
@ 100 Hz Offset
92
dBc/Hz
@ 1 kHz Offset
101
dBc/Hz
@ 10 kHz Offset
110
dBc/Hz
@ 100 kHz Offset
147
dBc/Hz
≥1 MHz Offset
153
dBc/Hz
TOTAL SYSTEM PHASE NOISE FOR 210 MHz
ADC CLOCK GENERATION CIRCUIT
Phase Noise of Fundamental
@ 10 Hz Offset
79.2
dBc/Hz
@ 100 Hz Offset
86
dBc/Hz
@ 1 kHz Offset
95
dBc/Hz
@ 10 kHz Offset
105
dBc/Hz
@ 100 kHz Offset
144
dBc/Hz
@ 1 MHz Offset
151
dBc/Hz
TOTAL SYSTEM TIME JITTER FOR CLOCKS
155.52 MHz Clock
581
fS rms
12 kHz to 1.3 MHz bandwidth
622.08 MHz Clock
188
fS rms
12 kHz to 5 MHz bandwidth
RF DIVIDER/CML DRIVER EQUIVALENT
INTRINSIC TIME JITTER
FIN = 414.72 MHz, FOUT = 51.84 MHz
136
fS rms
R = 8, BW = 12 kHz to 400 kHz
FIN = 1244.16 MHz, FOUT = 155.52 MHz
101
fS rms
R = 8, BW = 12 kHz to 1.3 MHz
FIN = 2488.32 MHz, FOUT = 622.08 MHz
108
fS rms
R = 4, BW = 12 kHz to 5 MHz
RF DIVIDER/CML DRIVER RESIDUAL PHASE NOISE
FIN = 81.92 MHz, FOUT = 10.24 MHz
RF Divider R = 8
@ 10 Hz
120
dBc/Hz
@ 100 Hz
128
dBc/Hz
@ 1 kHz
137
dBc/Hz
@ 10 kHz
145
dBc/Hz
@ 100 kHz
150
dBc/Hz
≥1 MHz
153
dBc/Hz
FIN = 983.04 MHz, FOUT = 122.88 MHz
RF Divider R = 8
@ 10 Hz
115
dBc/Hz
@ 100 Hz
125
dBc/Hz
@ 1 KHz
132
dBc/Hz
@ 10 kHz
142
dBc/Hz
@ 100 kHz
146
dBc/Hz
@ 1 MHz
151
dBc/Hz
>3 MHz
153
dBc/Hz
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