参数资料
型号: AD9726BSVZ
厂商: Analog Devices Inc
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文件大小: 0K
描述: IC DAC 16IT LVDS 400MSPS 80-TQFP
产品培训模块: Data Converter Fundamentals
DAC Architectures
标准包装: 1
系列: TxDAC+®
位数: 16
数据接口: 并联
转换器数目: 1
电压电源: 模拟和数字
功率耗散(最大): 575mW
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 80-TQFP 裸露焊盘
供应商设备封装: 80-TQFP-EP(12x12)
包装: 托盘
输出数目和类型: 2 电流,单极
采样率(每秒): 400M
产品目录页面: 785 (CN2011-ZH PDF)
配用: AD9726-EBZ-ND - BOARD EVAL FOR AD9726
AD9726
Rev. B | Page 6 of 24
Parameter
Min
Typ
Max
Unit
SERIAL PORT INTERFACE
SCLK Frequency (fSCLK)
15
MHz
SCLK Rise/Fall Time
1
ms
SCLK Pulse Width High (tCPWH)
30
ns
SCLK Pulse Width Low (tCPWL)
30
ns
SCLK Setup Time (tCSU)
30
ns
SDIO Setup Time (tDSU)
30
ns
SDIO Hold Time (tDH)
0
ns
SDIO/SDO Valid Time (tDV)
30
ns
RESET PULSE WIDTH
1.5
ns
TIMING DIAGRAMS
DAC CLOCK
DATACLOCK OUTPUT
DATACLOCK INPUT
DATA BUS
tDCPD-DDR
tDSU-DDR
tDH-DDR
04540-002
Figure 2. DDR Timing Diagram
DAC CLOCK
DATACLOCK OUTPUT
DATACLOCK INPUT
DATA BUS
tDCPD-SDR
tDSU-SDR
tDH-SDR
04540-003
Figure 3. SDR Timing Diagram
04
54
0-
10
0
DB0 TO DB15
CLK+/CLK–
IOUTA OR IOUTB
tPD-BYPASS
tDSU-BYPASS
tDH-BYPASS
Figure 4. Data Synchronization Bypass Timing Diagram
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参数描述
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