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参数资料
| 型号： | AD9957BSVZ-REEL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 6/64页 |
| 文件大小： | 0K |
| 描述： | IC DDS 1GSPS 14BIT IQ 100TQFP |
| 产品培训模块： | Direct Digital Synthesis Tutorial Series (1 of 7): Introduction Direct Digital Synthesizer Tutorial Series (7 of 7): DDS in Action Direct Digital Synthesis Tutorial Series (3 of 7): Angle to Amplitude Converter Direct Digital Synthesis Tutorial Series (6 of 7): SINC Envelope Correction Direct Digital Synthesis Tutorial Series (4 of 7): Digital-to-Analog Converter Direct Digital Synthesis Tutorial Series (2 of 7): The Accumulator |
| 标准包装： | 1,000 |
| 分辨率（位）： | 14 b |
| 主 fclk： | 1GHz |
| 调节字宽（位）： | 32 b |
| 电源电压： | 1.8V, 3.3V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-TQFP 裸露焊盘 |
| 供应商设备封装： | 100-TQFP-EP（14x14） |
| 包装： | 带卷 (TR) |
| 配用： | AD9957/PCBZ-ND - BOARD EVAL AD9957 QUADRATURE MOD |
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AD9957
Data Sheet
Rev. C | Page 14 of 64
–50
–55
–60
–65
–75
–70
06384-
058
S
F
DR
(
d
Bc)
FREQUENCY OUT (MHz)
SFDR WITHOUT PLL
SFDR WITH PLL
0
50
100
150
200
250
300
350
400
Figure 17. Wideband SFDR vs. Output Frequency in Single Tone Mode,
PLL with REFCLK = 15.625 MHz × 64
400
450
300
250
350
200
150
100
50
0
06384-
059
S
F
DR
(
d
Bc)
FREQUENCY OUT (MHz)
–75
–70
–65
–60
–55
–45
–50
LOW SUPPLY
HIGH SUPPLY
Figure 18. SFDR vs. Output Frequency and Supply (±5%) in Single Tone
Mode, REFCLK = 1 GHz
400
450
300
250
350
200
150
100
50
0
06384-
060
S
F
DR
(
d
Bc)
FREQUENCY OUT (MHz)
–75
–70
–65
–60
–55
–50
–40°C
+85°C
Figure 19. SFDR vs. Frequency and Temperature in Single Tone Mode,
REFCLK = 1 GHz
–90
–100
–120
–110
–140
–150
–130
–170
–160
10
100
1k
10k
100k
100M
1M
10M
06384-
061
M
AG
NI
T
UDE
(
d
Bc/
Hz
)
FREQUENCY OFFSET (Hz)
fOUT = 20.1MHz
fOUT = 98.6MHz
fOUT = 201.1MHz
fOUT = 397.8MHz
Figure 20. Residual Phase Noise, System Clock = 1 GHz
–90
–100
–110
–120
–130
–140
–150
–160
10
100
1k
10k
100k
1M
10M
100M
06384-
054
M
AG
NI
T
UDE
(
d
Bc/
Hz
)
FREQUENCY OFFSET (Hz)
fOUT = 20.1MHz
fOUT = 397.8MHz
fOUT = 98.6MHz
fOUT = 201.1MHz
Figure 21. Residual Phase Noise Using the REFCLK Multiplier,
REFCLK = 50 MHz with 20x Multiplication, System Clock = 1 GHz
1200
200
400
600
800
1000
0
100
200
300
400
500
600
700
800
900
1000
06384-
062
PO
W
ER
D
ISSI
PA
T
IO
N
(m
W
)
SYSTEM CLOCK FREQUENCY (MHz)
DVDD 3.3V
AVDD 3.3V
AVDD 1.8V
DVDD 1.8V
Figure 22. Power Dissipation vs. System Clock (PLL Disabled)
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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