参数资料
型号: ADP1850ACPZ-R7
厂商: Analog Devices Inc
文件页数: 9/32页
文件大小: 0K
描述: IC REG CTRLR BUCK PWM CM 32LFCSP
标准包装: 1
PWM 型: 电流模式
输出数: 2
频率 - 最大: 1.725MHz
占空比: 90%
电源电压: 2.75 V ~ 20 V
降压:
升压:
回扫:
反相:
倍增器:
除法器:
Cuk:
隔离:
工作温度: -40°C ~ 125°C
封装/外壳: 32-WFQFN 裸露焊盘,CSP
包装: 标准包装
其它名称: ADP1850ACPZ-R7DKR

Data Sheet
TYPICAL PERFORMANCE CHARACTERISTICS
100
5.10
ADP1850
90
80
70
V O = 3.3V, PSM
5.05
5.00
4.95
NO LOAD ON LDO
100mA LOAD ON LDO
60
50
40
V O = 1.8V, PSM
V O = 3.3V, PWM
4.90
4.85
30
20
10
V O = 1.8V, PWM
4.80
4.75
4.70
0
0.01
0.1
1
V IN = 12V, 600kHz
10 100
4.65
5
7
9
11
13
15
17
100
90
LOAD (A)
Figure 4. Efficiency Plot of Figure 44
6
V IN (V)
Figure 7. LDO Line Regulation
80
70
60
V O = 5V, PSM
5
4
50
V O = 1.8V, PSM
3
40
30
V O = 5V, PWM
2
20
10
V O = 1.8V, PWM
1
0
0.01
0.1
1
V IN = 12V, 750kHz
10
0
0
1
2
3
4
5
6
0
LOAD (A)
Figure 5. Efficiency Plot of Figure 45
V IN (V)
Figure 8. VCCO vs. V IN
–0.05
–0.10
–0.15
50mA LOAD
1
2
SW1
SW2
–0.20
100mA LOAD
3
SYNC 600kHz
–0.25
2.5
3.0
3.5
4.0
4.5
5.0
CH1 10V
CH2 10V
M1μs
A CH1
5.60V
V IN (V)
Figure 6. LDO Load Regulation
Rev. A | Page 9 of 32
CH3 5V
Figure 9. An Example of Synchronization, f SYNC = 600 kHz
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