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参数资料
| 型号： | ADSP-21489BSWZ-3B |
| 厂商： | Analog Devices Inc |
| 文件页数： | 35/68页 |
| 文件大小： | 0K |
| 描述： | IC CCD SIGNAL PROCESSOR 176LQFP |
| 标准包装： | 1 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | EBI/EMI，DAI，I²C，SPI，SPORT，UART/USART |
| 时钟速率： | 350MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 5Mb |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.10V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 176-LQFP 裸露焊盘 |
| 供应商设备封装： | 176-LQFP-EP（24x24） |
| 包装： | 托盘 |
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Rev. B
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March 2013
The SPORTx_TDV_O output signal (routing unit) becomes
active in SPORT multichannel mode. During transmit slots
(enabled with active channel selection registers) the
SPORTx_TDV_O is asserted for communication with external
devices.
Table 38. Serial Ports—TDV (Transmit Data Valid)
Parameter
Min
Max
Unit
Switching Characteristics1
tDRDVEN
TDV Assertion Delay from Drive Edge of External Clock
3
ns
tDFDVEN
TDV Deassertion Delay from Drive Edge of External Clock
8
ns
tDRDVIN
TDV Assertion Delay from Drive Edge of Internal Clock
–1
ns
tDFDVIN
TDV Deassertion Delay from Drive Edge of Internal Clock
2
ns
1 Referenced to drive edge.
Figure 24. Serial Ports—TDM Internal and External Clock
DRIVE EDGE
DAI_P20–1
(SCLK, EXT)
tDRDVEN
tDFDVEN
DRIVE EDGE
DAI_P20–1
(SCLK, INT)
tDRDVIN
tDFDVIN
TDVx
DAI_P20-1
TDVx
DAI_P20-1
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PDF描述 |
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参数描述 |
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