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参数资料
| 型号： | ADSP-2191MKSTZ-160 |
| 厂商： | ANALOG DEVICES INC |
| 元件分类： | 数字信号处理 |
| 英文描述： | 16-bit Fixed-Point DSP, 160 MIPS, 160K bytes RAM; Package: 144 ld LQFP (20x20mm); No of Pins: 144; Temperature Range: Comm. |
| 中文描述： | 16-BIT, 100 MHz, OTHER DSP, PQFP144 |
| 封装： | PLASTIC, LQFP-144 |
| 文件页数： | 17/48页 |
| 文件大小： | 1789K |
| 代理商： | ADSP-2191MKSTZ-160 |
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ADSP-2191M
–24–
REV. A
External Port Bus Request and Grant Cycle Timing
bus grant operations.
Table 14. External Port Bus Request and Grant Cycle Timing
Parameter1, 2
Min
Max
Unit
Switching Characteristics
t
SD
CLKOUT High to
xMS, Address, and RD/WR Disable
0.5t
HCLK +1
ns
t
SE
CLKOUT Low to
xMS, Address, and RD/WR Enable
04ns
t
DBG
CLKOUT High to
BG Asserted Setup
0
4
ns
t
EBG
CLKOUT High to
BG Deasserted Hold Time
0
4
ns
t
DBH
CLKOUT High to
BGH Asserted Setup
0
4
ns
t
EBH
CLKOUT High to
BGH Deasserted Hold Time
04ns
Timing Requirements
t
BS
BR Asserted to CLKOUT High Setup
4.6
ns
t
BH
CLKOUT High to
BR Deasserted Hold Time
0
ns
1t
HCLK is the peripheral clock period.
2These are timing parameters that are based on worst-case operating conditions.
Figure 13. External Port Bus Request and Grant Cycle Timing
tBH
A21–0
CLKOUT
tBS
tSD
tDBG
tDBH
tSE
tEBG
tEBH
BGH
WR
RD
MS3--0
IOMS
BMS
BR
BG
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PDF描述 |
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