参数资料
| 型号： | ADSP-21992YBC |
| 厂商： | Analog Devices Inc |
| 文件页数： | 33/60页 |
| 文件大小： | 0K |
| 描述： | IC DSP CTLR 16BIT 196CSPBGA |
| 标准包装： | 1 |
| 系列： | ADSP-21xx |
| 类型： | 定点 |
| 接口： | SPI，SSP |
| 时钟速率： | 150MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 128kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 2.50V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 196-BGA |
| 供应商设备封装： | 196-MBGA（15x15） |
| 包装： | 托盘 |
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ADSP-21992
Rev. A
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August 2007
External Port Bus Request/Grant Cycle Timing
bus grant operations.
Table 22. External Port Bus Request and Grant Cycle Timing
Parameter1, 2
Min
Max
Unit
Timing Requirements
tBS
BR Asserted to CLKOUT High Setup
4.6
ns
tBH
CLKOUT High to BR Deasserted Hold Time
0
ns
Switching Characteristics
tSD
CLKOUT High to xMS, Address, and RD/WR Disable
0.5tHCLK + 1
ns
tSE
CLKOUT Low to xMS, Address, and RD/WR Enable
04ns
tDBG
CLKOUT High to BG Asserted Setup
0
4
ns
tEBG
CLKOUT High to BG Deasserted Hold Time
0
4
ns
tDBH
CLKOUT High to BGH Asserted Setup
0
4
ns
tEBH
CLKOUT High to BGH Deasserted Hold Time
0
4
ns
1 tHCLK is the peripheral clock period.
2 These are timing parameters that are based on worst-case operating conditions.
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