参数资料
| 型号： | ADSP-21992YBC |
| 厂商： | Analog Devices Inc |
| 文件页数： | 40/60页 |
| 文件大小： | 0K |
| 描述： | IC DSP CTLR 16BIT 196CSPBGA |
| 标准包装： | 1 |
| 系列： | ADSP-21xx |
| 类型： | 定点 |
| 接口： | SPI，SSP |
| 时钟速率： | 150MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 128kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 2.50V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 196-BGA |
| 供应商设备封装： | 196-MBGA（15x15） |
| 包装： | 托盘 |
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ADSP-21992
Rev. A
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August 2007
Serial Peripheral Interface Port—Master Timing
Table 24. Serial Peripheral Interface (SPI) Port—Master Timing
Parameter
Min
Max
Unit
Timing Requirements
tSSPID
Data Input Valid to SCLK Edge (Data Input Setup)
8
ns
tHSPID
SCLK Sampling Edge to Data Input Invalid (Data In Hold)
1
ns
Switching Characteristics
tSDSCIM
SPISEL Low to First SCLK Edge
2tHCLK –3
ns
tSPICHM
Serial Clock High Period
2tHCLK –3
ns
tSPICLM
Serial Clock Low Period
2tHCLK –3
ns
tSPICLK
Serial Clock Period
4tHCLK –1
ns
tHDSM
Last SCLK Edge to SPISEL High
2tHCLK –3
ns
tSPITDM
Sequential Transfer Delay
2tHCLK –2
ns
tDDSPID
SCLK Edge to Data Output Valid (Data Out Delay)
0
6
ns
tHDSPID
SCLK Edge to Data Output Invalid (Data Out Hold)
0
5
ns
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