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参数资料
| 型号： | ADSP-BF548MBBCZ-5M |
| 厂商： | ANALOG DEVICES INC |
| 元件分类： | 数字信号处理 |
| 英文描述： | 533 MHz Blackfin Embedded Processor: ADSP-BF548MBBCZ-5M Temp Range: –40°C to +85°C Package: 400-Ball CSP_BGA BC-400-1 |
| 中文描述： | 16-BIT, 50 MHz, OTHER DSP, PBGA400 |
| 封装： | 17 X 17 MM, ROHS COMPLIANT, CSBGA-400 |
| 文件页数： | 65/100页 |
| 文件大小： | 3095K |
| 代理商： | ADSP-BF548MBBCZ-5M |
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ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
Rev. D
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May 2011
Timer Cycle Timing
input signal is asynchronous in “width capture mode” and
“external clock mode” and has an absolute maximum input fre-
quency of (fSCLK/2) MHz.
Table 48. Timer Cycle Timing
Parameter
Min
Max
Unit
Timing Characteristics
tWL
Timer Pulse Width Input Low
1
tSCLK +1
ns
tWH
Timer Pulse Width Input High
tSCLK +1
ns
tTIS
Timer Input Setup Time Before CLKOUT Low2
6.5
ns
tTIH
Timer Input Hold Time After CLKOUT Low2
–1
ns
Switching Characteristics
tHTO
Timer Pulse Width Output
1× tSCLK
(2
32 – 1) × t
SCLK
ns
tTOD
Timer Output Delay After CLKOUT High
6
ns
1 The minimum pulse widths apply for TMRx signals in width capture and external clock modes.
2 Either a valid setup and hold time or a valid pulse width is sufficient. There is no need to resynchronize timer flag inputs.
Figure 42. Timer Cycle Timing
CLKOUT
TMRx OUTPUT
TMRx INPUT
tTIS
tTIH
tWH,tWL
tTOD
tHTO
相关PDF资料 |
PDF描述 |
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