参数资料
| 型号： | AS3517-T |
| 厂商： | ams |
| 文件页数： | 19/94页 |
| 文件大小： | 0K |
| 描述： | IC CODEC AFE AUDIO STER 81-CTBGA |
| 标准包装： | 2,000 |
| 类型： | 音频编解码器 |
| 应用： | 便携式音频，电话 |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 81-TFBGA |
| 供应商设备封装： | 81-CTBGA（9x9） |
| 包装： | 带卷 (TR) |
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AS3517 V17
Data Sheet, Confidential
2003-2007, austriamicrosystems AG, 8141 Unterpremstaetten, Austria-Europe. All Rights Reserved.
www.austriamicrosystems.com
Table 20Table 21
I2S Master clock PLL settings
fOSC
fsample (LRCK)
PLL-Mode
RD (Rate Divider)
Deviation
24MHz
48.00kS
1
123
0.00%
24MHz
44.10kS
1
134
0.04%
24MHz
32.00kS
1
186
-0.27%
24MHz
24.00kS
1
248
0.00%
24MHz
22.05kS
1
270
0.04%
24MHz
16.00kS
1
373
0.00%
24MHz
12.00kS
2
248
0.00%
24MHz
11.025kS
2
270
0.04%
24MHz
8.00kS
2
373
0.00%
fOSC
fsample (LRCK)
PLL-Mode
RD (Rate Divider)
Deviation
16MHz
48.00kS
1
81
0.40%
16MHz
44.10kS
1
179
-0.33%
16MHz
32.00kS
1
123
0.00%
16MHz
24.00kS
1
165
-0.20%
16MHz
22.05kS
1
179
0.22%
16MHz
16.00kS
1
248
0.00%
16MHz
12.00kS
2
165
-0.20%
16MHz
11.025kS
2
179
0.22%
16MHz
8.00kS
2
248
0.00%
fOSC
fsample (LRCK)
PLL-Mode
RD (Rate Divider)
Deviation
12MHz
48.00kS
1
61
-0.79%
12MHz
44.10kS
1
66
0.04%
12MHz
32.00kS
1
92
0.27%
12MHz
24.00kS
1
123
0.00%
12MHz
22.05kS
1
134
0.04%
12MHz
16.00kS
1
185
0.27%
12MHz
12.00kS
2
123
0.00%
12MHz
11.025kS
2
134
0.04%
12MHz
8.00kS
2
185
0.27%
Parameter
Figure 10 I2S Left Justified Mode
Revision 1v3
25
- 93
ams
AG
Technical
content
still
valid
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PDF描述 |
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参数描述 |
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