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参数资料
| 型号： | AS5SS256K36ADQ-8.5/883C |
| 厂商： | AUSTIN SEMICONDUCTOR INC |
| 元件分类： | SRAM |
| 英文描述： | 256K x 36 SSRAM Flow-Through, Synchronous Burst SRAM |
| 中文描述： | 256K X 36 STANDARD SRAM, 8.5 ns, PQFP100 |
| 封装： | 14 X 20 MM, 1.40 MM HEIGHT, MS-026, TQFP-100 |
| 文件页数： | 4/16页 |
| 文件大小： | 391K |
| 代理商： | AS5SS256K36ADQ-8.5/883C |
SSRAM
AS5SS256K36 &
AS5SS256K36A
AS5SS256K36 &
AS5SS256K36A
Rev. 3.6 06/05
Austin Semiconductor, Inc. reserves the right to change products or specifications without notice.
12
Austin Semiconductor, Inc.
READ TIMING3
NOTE: 1. Q(A2) refers to output from address A2. Q(A2+1) refers to output from the next internal burst address following A2.
2. CE2\ and CE2 have timing identical to CE\. On this diagram, when CE\ is LOW, CE2\ is LOW and CE2 is HIGH. When CE\ is
HIGH, CE2\ is HIGH and CE2 is LOW.
3. Timing is shown assuming that the device was not enabled before entering into this sequence.
4. Outputs are disabled t
KQHZ
after deselect.
MIN
MAX
MIN
MAX
tKC
10.0
15
ns
tKF
100
66
MHz
tKH
3.0
4.0
ns
tKL
3.0
4.0
ns
tKQ
8.5
10.0
ns
tKQX
3.0
ns
tKQLZ
3.0
ns
tKQHZ
5.0
ns
tOEQ
5.0
ns
tOELZ
00
ns
tOEHZ
5.0
ns
SYMBOL
-8.5
-10
UNITS
READ/WRITE TIMING PARAMETERS
MIN
MAX
MIN
MAX
tAS
1.8
2.0
ns
tADSS
1.8
2.0
ns
tAAS
1.8
2.0
ns
tWS
1.8
2.0
ns
tCES
1.8
2.0
ns
tAH
0.5
ns
tADSH
0.5
ns
tAAH
0.5
ns
tWH
0.5
ns
tCEH
0.5
ns
SYMBOL
-8.5
-10
UNITS
123456789012
12345
123456789
12345
1234
123456
12345678901234
1234
1234567890
1234
12345
123456
12
CLK
ADSP\
ADSC\
○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○
○○○○○○○
○○○○○○○○○○○○○○
○○○○○○○○○○○○○○○○○○○○○○○○○○
○○○○○○○○○○○○○○○○○○○○
○
○○○○○○○○○○○○○○○○○○○
○○○○○○
○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○
○
○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○
○
○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○
○○○○○○○○○○
○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○
○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○
○○○○○○○○
○○○○○○○
○
○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○
○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○
○○○○○○
ADDRESS
BWE\, GW\,
BWa\ - BWd\
○
○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○○
CE\
(Note 2)
ADV\
OE\
t
ADSH
t
AS
t
AH
t
KQLZ
t OEHZ
SINGLE READ
BURST READ
○○○○○○○○○○○○○○
○
○○○○○○○○○○○○○○○○○○○○○○○○○○
Q
t
1234
12345678
123
12345678
123456789012345678901234567890121234567890123456789012345678901212345678901234567890
1
AAS
tAAH
t
Q(A2)
Q(A2+2)
12
Q(A2+3)
12
Q(A2)
123
12
Q(A2+1)
12
1
Q(A2+2)
123456
1234
123456
12345
123456
1234567
12
123456
1234567
123456
Q(A1)
Q(A2+1)
123456
t
KC
t
KL
123456
1234567890123456789012
1
12345
123456
1234567890123456789012345678901212345678901234567890123456789012123456789012345678
123456
1234567890123456789012
1
1234567890123
12345678
1
123
1234
t
KH
t
OEQ
tOELZ
t KQ
123456
Deselect Cycle
(note 4)
123456
ADSS
t
ADSH
t
ADSS
A2
A1
t
WS
t
WH
t
CEH
t
CES
ADV\ suspends burst.
High-Z
t KQ
tKQX
tKQHZ
Burst wraps around to
its initial state
(Note 1)
1234
Don’t Care
Undefined
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