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参数资料
| 型号： | AT89LP3240-20PU |
| 厂商： | Atmel |
| 文件页数： | 45/200页 |
| 文件大小： | 0K |
| 描述： | MCU 8051 32K FLASH 20MHZ |
| 标准包装： | 10 |
| 系列： | 89LP |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 20MHz |
| 连通性： | I²C，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 38 |
| 程序存储器容量： | 32KB（32K x 8） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 8K x 8 |
| RAM 容量： | 4.25K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.4 V ~ 3.6 V |
| 数据转换器： | A/D 8x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 40-DIP（0.540"，13.72mm） |
| 包装： | 管件 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页当前第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页
139
3706C–MICRO–2/11
AT89LP3240/6440
Table 20-2.
DADC
– DADC Control Register
DADC = D9H
Reset Value = 0000 0000B
Not Bit Addressable
ADIF
GO/BSY
DAC
ADCE
LADJ
ACK2
ACK1
ACK0
Bit
7
6
543
21
0
Symbol
Function
ADIF
ADC Interrupt Flag. Set by hardware when a conversion completes. Cleared by hardware when calling the interrupt
service routine.
GO/BSYConversion Start/Busy Flag. In software triggered mode, writing a 1 to this bit starts a conversion. The bit remains high
while the conversion is in progress and is cleared by hardware when the conversion completes. In hardware triggered
mode, this bit is set and cleared by hardware to flag when the DADC is busy.
DAC
Digital-to-Analog Conversion Enable. Set to configure the DADC in Digital-to-Analog (DAC) mode. Clear to configure the
DADC in Analog-to-Digital (ADC) mode.
ADCE
DADC Enable. Set to enable the DADC. Clear to disable the DADC.
LADJ
Left Adjust Enable. When cleared, the ADC results are right adjusted and the MSBs are sign extended. When set, the
ADC results are left adjusted and the LSBs are zeroed.
ACK [2-0]
DADC Clock Select
ACK3
ACK1
ACK0
Clock Source
000Internal RC Oscillator/4 (2MHz)
001fsys/2
010f
sys/4
011f
sys/8
100fsys/16
101f
sys/32
110f
sys/64
111fsys/128
Table 20-3.
DADL
– DADC Data Low Register
DADL = DCH
Reset Value = 0000 0000B
Not Bit Addressable
ADC.7
ADC.6
ADC.5
ADC.4
ADC.3
ADC.2
ADC.1
ADC.0
Bit
7
6
543
21
0
Table 20-4.
DADH
– DADC Data High Register
DADH = DDH
Reset Value = 0000 0000B
Not Bit Addressable
ADC.15
ADC.14
ADC.13
ADC.12
ADC.11
ADC.10
ADC.9
ADC.8
Bit
7
6
543
21
0
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| AT89LP4052-16XI | 功能描述:8位微控制器 -MCU Microcontroller RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
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