参数资料
| 型号： | CDB8422 |
| 厂商： | Cirrus Logic Inc |
| 文件页数： | 19/46页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR CS8422 RCVR |
| 标准包装： | 1 |
| 主要目的： | 音频，采样率转换器 |
| 嵌入式： | 是，FPGA / CPLD |
| 已用 IC / 零件： | CS8422 |
| 主要属性： | PCM，IEC-60958，AES3/EBU，S/PDIF，以及 XLR 输入，RCA 同轴和光学 S/PDIF 输出 |
| 次要属性： | 28 ~ 216 kHz 采样率范围，输入/输出率范围从 6:1 至 1:6 |
| 已供物品： | 板 |
| 产品目录页面： | 759 (CN2011-ZH PDF) |
| 相关产品： | 598-1732-ND - IC SAMPLE RATE CONVERTER 32QFN |
| 其它名称： | 598-1568 |
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CDB8422
2.5.3.3
SAO2 Subclock Source (SAO2_MS)
Default = 00
Function:
These bits control the direction of the LRCK and SCLK signals between the SAO2 header J25 and the
CS8422. The CS8422’ SAO2 port should be configured in the appropriate master/slave mode.
SAO2_MS Setting
SAO2 Subclock Source
00 ........................................HDR J25 drives CS8422’s OLRCK2 and OSCLK2 inputs.
01 ........................................CS8422’s OLRCK2 and OSCLK2 outputs drive HDR J25.
10 ........................................Reserved.
11.........................................Reserved.
2.5.3.4
SAO1 Subclock Source (SAO1_MS)
Default = 00
Function:
These bits control the direction of the LRCK and SCLK signals between the SAO1 header J24, the
CS8422, and the CS8406. The CS8406 will automatically switch between master and slave modes. The
CS8422’s SAO1 port should be configured in the appropriate master/slave mode.
SAO1_MS Setting
SAO1 Subclock Source
00 ........................................HDR J24 drives CS8422’s OLRCK1 and OSCLK1 inputs and CS8406’s ILRCK and ISCLK inputs.
01 ........................................CS8406’s ILRCK and ISCLK outputs drive HDR J24 and CS8422’s OLRCK1 and OSCLK1 inputs.
10 ........................................CS8422’s OLRCK1 and OSCLK1 outputs drive HDR J24 and CS8406’s ILRCK and ISCLK inputs.
11.........................................Reserved.
2.5.4
CS8406 Control 1 (Address 04h)
7
HWCK1
6
HWCK0
5
VBIT_IN
4
UBIT_IN
3
TCBL
2
CBIT_INT
1
SFMT1
0
SFMT0
2.5.4.1
OMCK/ILRCK Ratio (HWCK)
Default = 00
Function:
These bits control the ratio between the CS8406’s OMCK and ILRCK signals.
HWCK Setting
OMCK/ILRCK Ratio
00 ........................................ILRCK = OMCK/256.
01 ........................................ILRCK = OMCK/128.
10 ........................................ILRCK = OMCK/512.
11.........................................Reserved.
2.5.4.2
Validity Bit (VBIT_IN)
Default = 0
Function:
This bit controls the state of the validity bit for the CS8406’s output S/PDIF data.
VBIT_IN Setting
Validity Polarity
0 ..........................................Low.
1 ..........................................High.
DS692DB2
19
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