参数资料
| 型号： | CDB8422 |
| 厂商： | Cirrus Logic Inc |
| 文件页数： | 26/46页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR CS8422 RCVR |
| 标准包装： | 1 |
| 主要目的： | 音频，采样率转换器 |
| 嵌入式： | 是，FPGA / CPLD |
| 已用 IC / 零件： | CS8422 |
| 主要属性： | PCM，IEC-60958，AES3/EBU，S/PDIF，以及 XLR 输入，RCA 同轴和光学 S/PDIF 输出 |
| 次要属性： | 28 ~ 216 kHz 采样率范围，输入/输出率范围从 6:1 至 1:6 |
| 已供物品： | 板 |
| 产品目录页面： | 759 (CN2011-ZH PDF) |
| 相关产品： | 598-1732-ND - IC SAMPLE RATE CONVERTER 32QFN |
| 其它名称： | 598-1568 |
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CDB8422
Switch S4 controls the data format options for both serial output ports, see Table 4 for switch configurations.
For SDOUT2, the output resolution will be equal to the resolution of the incoming receiver data. The excep-
tion is the case where right-justified mode is selected and the receiver input word-length is an odd number
of bits. In this case, the SDOUT2 word-length will be zero-stuffed to be 1 bit longer than the receiver input
word-length (example: a 19-bit receiver input word will result in an 20-bit right-justified serial format).
SAOF[3:0]
0000
0001
0010
0011
0100
0101
0110
0111
1000
1001
1010
1011
1100
1101
1110
SDOUT1
I2S 24-bit
I2S 20-bit
I2S 16-bit
Left-Justified 24-bit
Left-Justified 20-bit
Left-Justified 16-bit
Right-Justified 24-bit
(Master Mode only)
Right-Justified 20-bit
(Master Mode only)
Right-Justified 16-bit
(Master Mode only)
TDM Mode 24-bit
TDM Mode 20-bit
TDM Mode 16-bit
Reserved
SDOUT2
I2S
Left-Justified
Right-Justified
(Master Mode only)
I2S
Reserved
1111
Table 4. S4 Settings
26
Note:
The CS8406 does not support Right-Justified 20-bit resolution in hardware mode.
DS692DB2
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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