参数资料
| 型号： | CDB8422 |
| 厂商： | Cirrus Logic Inc |
| 文件页数： | 24/46页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR CS8422 RCVR |
| 标准包装： | 1 |
| 主要目的： | 音频，采样率转换器 |
| 嵌入式： | 是，FPGA / CPLD |
| 已用 IC / 零件： | CS8422 |
| 主要属性： | PCM，IEC-60958，AES3/EBU，S/PDIF，以及 XLR 输入，RCA 同轴和光学 S/PDIF 输出 |
| 次要属性： | 28 ~ 216 kHz 采样率范围，输入/输出率范围从 6:1 至 1:6 |
| 已供物品： | 板 |
| 产品目录页面： | 759 (CN2011-ZH PDF) |
| 相关产品： | 598-1732-ND - IC SAMPLE RATE CONVERTER 32QFN |
| 其它名称： | 598-1568 |
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CDB8422
3.2.2
TDM In to TDM Out
The CS8422’s TDM output performance can be tested by setting the hardware switches as shown in
Table 2 . This configures the digital clock and data signal routing on the board as shown in Figure 13 .
TDM audio input data is provided by the TDM input header J30. The LRCK and SCLK signals located at
header J30 should be used to clock in the input TDM data. Optionally, digital AES3/EBU input can be pro-
vided by the XLR jack J19 to the RXP0 and RXN0 pins of the CS8422. The CS8422’s internal circuitry is
configured to multiplex the TDM input and AES3/EBU input data together and send the output data to se-
rial output port 1. This data is presented as TDM audio at header J24. The AES3/EBU input data is also
passed through (not multiplexed) to serial output port 2. This data is presented as PCM audio at header
J25. Refer to Section 3.3 for full details on hardware configuration.
Switch
S3
S4
S7
Position
MS_SEL[3:0]
SAOF[3:0]
RX_SELECT
TX_SELECT
TX_U/OUT SEL
NV/RERR SEL
V/AUDIO SEL
SRC MCK SEL
Table 2. Switch Settings - TDM In to TDM Out
Buffer
Setting
1010
1001
0
0
0
0
0
0
Header
J30
Y1
J23
TDM IN
TDM
OSCLK
TDM
OLRCK
TDM
In
XTI TDM_IN
OSCLK1
(MASTER) OLRCK1
SDOUT1
Buffer
Header
J24
OSCLK1
OLRCK1
SDOUT1
TDM
Out
J21
RXP0
MCLK_OUT
MCLK OUT
AES3/EBU
In
J19
J29
RXP1
RXN0
RXN1
CS8422
Buffer
Header
J25
24
RMCK
OSCLK2
(MASTER) OLRCK2
SDOUT2
Figure 13. TDM In to TDM Out
MCLK OUT
OSCLK2
OLRCK2
SDOUT2
PCM Out
no SRC
DS692DB2
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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