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参数资料
| 型号： | CS62180 |
| 厂商： | Cirrus Logic, Inc. |
| 元件分类： | 通信及网络 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件页数： | 4/50页 |
| 文件大小： | 411K |
| 代理商： | CS62180 |
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Notes:15. Average reframe time is the time from the rising edge of RLOS until the rising edge of RMSYNC
which updates the receiver output timing.
16. With error free data.
SWITCHING CHARACTERISTICS - TRANSMITTER
(T
A
= -40 to 85
°
C; V
DD
= 5V
±
10%; V
IH
= 2.0V; V
IL
= 0.8V; Maximum input rise & fall times of 10 ns)
Parameter
Symbol
Min
Typ
Max
Units
TCLK Period
TCLK Pulse Width
TCLK Rise & Fall Times
TSER, TABCD, TLINK Setup to TCLK Falling
TSER, TABCD, TLINK Hold from TCLK Falling
TFSYNC, TMSYNC Setup to TCLK Rising
TFSYNC, TMSYNC Pulse Width
Propagation Delays
TFSYNC to TMO, TSIGSEL, TSIGFR, TLCLK
TCLK Rising to TCHCLK
t
P
250
125
-
50
50
-125
100
648
324
20
-
-
-
-
-
-
-
-
-
ns
ns
ns
ns
ns
ns
ns
t
WL
, t
WH
t
F
, t
R
t
STD
t
HTD
t
STS
t
TSP
125
-
t
PTS
t
PTCH
-
-
-
-
75
75
ns
ns
SWITCHING CHARACTERISTICS - RECEIVER
(T
A
= -40 to 85
°
C; V
DD
= 5V
±
10%; V
IH
= 2.0V; V
IL
= 0.8V; Maximum input rise & fall times of 10 ns)
Parameter
Symbol
Min
Typ
Max
Units
Transition Time, All Outputs
RCLK Period
RCLK Pulse Width
RCLK Rise & Fall Times
RPOS, RNEG Setup to RCLK Falling
RPOS, RNEG Hold to RCLK Falling
Minimum RST Pulse Width on System Power Up or Restart
Propagation Delays
RCLK to RMSYNC, RFSYNC,RSIGSEL,
RSIGFR, RLCLK, RCHCLK
RCLK to RSER, RABCD, RLINK
RCLK to RYEL, RCL, RFER, RLOS, RBV
Average Reframe Time
193S
t
TTR
t
P
-
-
20
-
-
-
-
-
-
ns
ns
ns
ns
ns
ns
μ
s
250
100
-
50
50
1
648
324
20
-
-
-
t
WL
, t
WH
t
F
, t
R
t
SRD
t
HRD
t
RST
t
PRS
-
-
75
ns
t
PRD
t
PRA
-
-
-
-
75
75
ns
ns
(Notes 15 and 16)
RCR.2 = 0
RCR.2 = 1
RCR.2 = 0
RCR.2 = 1
t
RS
-
-
-
-
-
3.75
7.25
7.5
14.5
750
-
-
-
-
-
ms
ms
ms
ms
μ
s
ms
193E
t
RS
T1DM
SLC-96
t
RS
t
RS
-
6.0
-
CS62180B
4
DS225PP
2
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PDF描述 |
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