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参数资料
| 型号： | DK-NIOS-2S60N |
| 厂商： | Altera |
| 文件页数： | 18/56页 |
| 文件大小： | 0K |
| 描述： | NIOS II KIT W/STRATIX II EP2S60N |
| 标准包装： | 1 |
| 系列： | Stratix® II |
| 类型： | Nios?II |
| 适用于相关产品： | Stratix ll 2S60N |
| 所含物品： | 评估板，设计应用程序，软件，线缆和配件 |
| 相关产品： | 544-1906-ND - IC STRATIX II FPGA 60K 484-FBGA 544-1907-ND - IC STRATIX II FPGA 60K 484-FBGA 544-1908-ND - IC STRATIX II FPGA 60K 484-FBGA 544-1910-ND - IC STRATIX II FPGA 60K 484-FBGA 544-1912-ND - IC STRATIX II FPGA 60K 672-FBGA 544-1913-ND - IC STRATIX II FPGA 60K 672-FBGA 544-1914-ND - IC STRATIX II FPGA 60K 672-FBGA 544-1916-ND - IC STRATIX II FPGA 60K 672-FBGA 544-1915-ND - IC STRATIX II FPGA 60K 672-FBGA 544-1909-ND - IC STRATIX II FPGA 60K 484-FBGA 更多... |
| 其它名称： | 544-1697 |
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Seven-Segment LEDs (U8 & U9)
Figure 2–2. Push Button Switches & Individual LEDs
Seven-Segment
LEDs (U8 & U9)
SRAM Memory
(U35 & U36)
U8 and U9 are connected to the Stratix II device so that each segment is
individually controlled by a general-purpose I/O pin. When the Stratix II
pin drives logic 0, the corresponding LED turns on. See Figure 2–3 for
Stratix II pin-out details.
Figure 2–3. Seven-Segment LEDs
U35 and U36 are IDT IDT71V416S, 512 Kbyte x 16-bit asynchronous
SRAM devices. They are connected to the Stratix II device so they can be
used by a Nios II embedded processor as general-purpose memory. The
two 16-bit devices can be used in parallel to implement a 32-bit wide
memory subsystem. The factory programmed Nios II reference design
identifies these SRAM devices in its address space as a contiguous
1Mbyte, 32-bit-wide, zero-wait-state main memory.
The SRAM devices share address and data connections with the flash
memory and the Ethernet MAC/PHY device. For shared bus
information, see Appendix A, Shared Bus Table .
2–10
Nios Development Board Reference Manual, Stratix II Edition
Altera Corporation
July 2005
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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