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参数资料
| 型号： | DK-NIOS-2S60N |
| 厂商： | Altera |
| 文件页数： | 39/56页 |
| 文件大小： | 0K |
| 描述： | NIOS II KIT W/STRATIX II EP2S60N |
| 标准包装： | 1 |
| 系列： | Stratix® II |
| 类型： | Nios?II |
| 适用于相关产品： | Stratix ll 2S60N |
| 所含物品： | 评估板，设计应用程序，软件，线缆和配件 |
| 相关产品： | 544-1906-ND - IC STRATIX II FPGA 60K 484-FBGA 544-1907-ND - IC STRATIX II FPGA 60K 484-FBGA 544-1908-ND - IC STRATIX II FPGA 60K 484-FBGA 544-1910-ND - IC STRATIX II FPGA 60K 484-FBGA 544-1912-ND - IC STRATIX II FPGA 60K 672-FBGA 544-1913-ND - IC STRATIX II FPGA 60K 672-FBGA 544-1914-ND - IC STRATIX II FPGA 60K 672-FBGA 544-1916-ND - IC STRATIX II FPGA 60K 672-FBGA 544-1915-ND - IC STRATIX II FPGA 60K 672-FBGA 544-1909-ND - IC STRATIX II FPGA 60K 484-FBGA 更多... |
| 其它名称： | 544-1697 |
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Board Components
Figure 2–17. Reset, Config Button
JTAG
Connectors (J24
& J5)
Altera Corporation
July 2005
The Nios development board, has two 10-pin JTAG headers (J24 and J5)
compatible with Altera download cables, such as the USB-Blaster ? . Each
JTAG header connects to one Altera device and forms a single-device
JTAG chain. J24 connects to the Stratix II device (U60), and J5 connects to
the EPM7128AE device (U3).
JTAG Connector to Stratix II Device (J24)
J24 connects to the JTAG pins (TCK, TDI, TDO, TMS, TRST) of the
Stratix II device (U60) as shown in Figure 2–18 . Altera Quartus II
software can directly configure the Stratix II device with a new hardware
image via an Altera download cable as shown in Figure 2–19 . In addition,
the Nios II IDE can access the Nios II processor JTAG debug module via
a download cable connected to the J24 JTAG connector.
Figure 2–18. JTAG Connector (J24) to Stratix II Device
2–31
Nios Development Board Reference Manual, Stratix II Edition
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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