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参数资料
| 型号： | DS2151QB |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 54/60页 |
| 文件大小： | 0K |
| 描述： | IC TXRX T1 1-CHIP 5V LP 44-PLCC |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 26 |
| 功能： | 单芯片收发器 |
| 接口： | T1 |
| 电路数： | 1 |
| 电源电压： | 4.75 V ~ 5.25 V |
| 电流 - 电源： | 65mA |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 44-LCC（J 形引线） |
| 供应商设备封装： | 44-PLCC（16.59x16.59） |
| 包装： | 管件 |
| 包括： | 警报检测器和发生器，CSU 回路代码发生器和检测器，DSX-1和CSU 线路补偿发生器 |
| 产品目录页面： | 1429 (CN2011-ZH PDF) |
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DS2151Q
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Table 16-3. AC Characteristics—Transmit Side
(VDD = 5V ±5%, TA = 0°C to +70°C for DS2151Q, TA = -40°C to +85°C for DS2151QN.)
(See Figure 16-5.)
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
NOTES
TCLK Period
tP
648
ns
tCH
75
ns
TCLK Pulse Width
tCL
75
ns
TSER and TLINK Set up to
TCLK Falling
tSU
25
ns
1
TSER and TLINK Hold from
TCLK Falling
tHD
25
ns
1
TSYNC Set up to TCLK
Falling
tSU
25
tCH -5
TSYNC Pulse Width
tPW
50
TCLK Rise/Fall Times
tR, tF
25
ns
Delay TCLK to TCHCLK
tD1
10
60
ns
Delay TCLK to TCHBLK
tD2
10
70
ns
Delay TCLK to TSYNC
tD3
10
60
ns
Delay TCLK to TLCLK
tD4
10
60
ns
NOTES:
1) If the transmit side elastic store is enabled, then TSER is sampled on the falling edge of SYSCLK and
the parameters tSU and tHD still apply.
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| DS2151QB+T&R | 制造商:Maxim Integrated Products 功能描述:FRAMER DS1/E1/ISDN-PRI/T1 5V 44PLCC - Tape and Reel |
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