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参数资料
| 型号： | DS2153Q-A7+T&R |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 43/60页 |
| 文件大小： | 0K |
| 描述： | IC TXRX E1 1-CHIP 5V 44-PLCC |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 500 |
| 功能： | 单芯片收发器 |
| 接口： | E1 |
| 电路数： | 1 |
| 电源电压： | 4.75 V ~ 5.25 V |
| 电流 - 电源： | 65mA |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 44-LCC（J 形引线） |
| 供应商设备封装： | 44-PLCC（16.59x16.59） |
| 包装： | 带卷 (TR) |
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DS2153Q
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Figure 14-5. Transmit Side Timing
Figure 14-6. Transmit Side Boundary Timing
NOTE 1: TSYNC IN THE FRAME MODE (TCR1.1 = 0).
NOTE 2: TSYNC IN THE MULTIFRAME MODE (TCR1.1 = 1).
NOTE 3: TLINK IS PROGRAMMED TO SOURCE ONLY THE Sa4 BIT.
NOTE 4: THIS DIAGRAM ASSEMBLES BOTH THE CAS MF AND THE CRC4 BEGIN WITH THE ALIGN FRAME.
NOTE 1: TSYNC IS IN THE INPUT MODE (TCR1.0 = 0).
NOTE 2: TSYNC IS IN THE OUTPUT MODE (TCR1.0 = 1).
NOTE 3: TCHBLK IS PROGRAMMED TO BLOCK CHANNEL 2.
NOTE 4: TLINK IS PROGRAMMED TO SOURCE THE SA4 BITS.
NOTE 5: TLINK IS PROGRAMMED TO SOURCE THE SA7 AND SA8 BITS.
NOTE 6: SHOWN IS A NON-ALIGN FRAME BOUNDARY.
NOTE 7: SEE Figure 14-3 AND Figure 14-4 FOR DETAILS ON TIMING WITH THE TRANSMIT SIDE ELASTIC STORE ENABLED.
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PDF描述 |
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