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参数资料
| 型号： | DS21552LN+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 21/137页 |
| 文件大小： | 0K |
| 描述： | IC TXRX T1 1-CHIP 5V 100-LQFP |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 90 |
| 功能： | 单芯片收发器 |
| 接口： | E1，HDLC，J1，T1 |
| 电路数： | 1 |
| 电源电压： | 4.75 V ~ 5.25 V |
| 电流 - 电源： | 75mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-LQFP（14x14） |
| 包装： | 托盘 |
| 包括： | DSX-1 和 CSU 线路补偿发生器，HDLC 控制器，带内回路代码发生器和检测器 |
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DS21352/DS21552
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Figure 21-10 TRANSMIT SIDE BOUNDARY TIMING (with elastic store
disabled)
Notes:
1. TSYNC is in the output mode (TCR2.2 = 1)
2. TSYNC is in the input mode (TCR2.2 = 0)
3. TCHBLK is programmed to block channel 2
4. Shown is TLINK/TLCLK in the ESF framing mode
Figure 21-11 TRANSMIT SIDE 1.544 MHz BOUNDARY TIMING (with elastic
store enabled)
Notes:
1. TCHBLK is programmed to block channel 24 (if the TPCSI bit is set, then the signaling data at TSIG will be ignored during
channel 24).
LSB
F
MSB
LSB MSB
CHANNEL 1
CHANNEL 2
CHANNEL 1
CHANNEL 2
AB
C/A
D/B
AB
C/A
D/B
TCLK
TSER
TSYNC
TSIG
TCHCLK
TCHBLK
TLCLK
TLINK
D/B
1
2
3
4
DON'T CARE
LSB
F MSB
LSB MSB
CHANNEL 1
CHANNEL 24
A
B
C/A D/B
A
B
C/A D/B
TSYSCLK
TSER
TSSYNC
TSIG
TCHCLK
TCHBLK
CHANNEL 23
A
CHANNEL 23
CHANNEL 24
CHANNEL 1
1
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