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参数资料
| 型号： | DSP56303AG100 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 26/108页 |
| 文件大小： | 0K |
| 描述： | IC DSP 24BIT 100MHZ 144-LQFP |
| 特色产品： | DSP56303 24-bit Digital Signal Processor |
| 标准包装： | 60 |
| 系列： | DSP563xx |
| 类型： | 定点 |
| 接口： | 主机接口，SSI，SCI |
| 时钟速率： | 100MHz |
| 非易失内存： | ROM（576 B） |
| 芯片上RAM： | 24kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 3.30V |
| 工作温度： | -40°C ~ 100°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 144-LQFP |
| 供应商设备封装： | 144-LQFP（20x20） |
| 包装： | 托盘 |
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DSP56303 Technical Data, Rev. 11
2-4
Freescale Semiconductor
Specifications
2.5.2
External Clock Operation
The DSP56303 system clock is derived from the on-chip oscillator or is externally supplied. To use the on-chip
oscillator, connect a crystal and associated resistor/capacitor components to EXTAL and XTAL; examples are
shown in Figure 2-1.
If an externally-supplied square wave voltage source is used, disable the internal oscillator circuit during bootup by
setting XTLD (PCTL Register bit 16 = 1—see the DSP56303 User’s Manual). The external square wave source
connects to EXTAL; XTAL is not physically connected to the board or socket. Figure 2-2 shows the relationship
between the EXTAL input and the internal clock and CLKOUT.
Internal clock and CLKOUT cycle time with
PLL disabled
TC
—2
× ETC
—
Instruction cycle time
ICYC
—TC
—
Notes:
1.
DF = Division Factor; Ef = External frequency; ETC = External clock cycle; MF = Multiplication Factor;
PDF = Predivision Factor; TC = internal clock cycle
2.
See the PLL and Clock Generation section in the
DSP56300 Family Manual for a detailed discussion of the PLL.
Figure 2-1.
Crystal Oscillator Circuits
Figure 2-2.
External Clock Timing
Table 2-4.
Internal Clocks, CLKOUT (Continued)
Characteristics
Symbol
Expression1, 2
Min
Typ
Max
Suggested Component Values:
fOSC = 4 MHz
R = 680 k
± 10%
C = 56 pF
± 20%
Calculations were done for a 4/20 MHz crystal
with the following parameters:
CLof 30/20 pF,
C0 of 7/6 pF,
series resistance of 100/20
, and
drive level of 2 mW.
XTAL1
C
R
Fundamental Frequency
Crystal Oscillator
XTAL
EXTAL
fOSC = 20 MHz
R = 680 k
± 10%
C = 22 pF
± 20%
Note: Make sure that in
the PCTL Register:
XTLD (bit 16) = 0
If fOSC > 200 kHz,
XTLR (bit 15) = 0
EXTAL
VILX
VIHX
Midpoint
Note:
The midpoint is
0.5 (VIHX + VILX).
ETH
ETL
ETC
CLKOUT with
PLL disabled
CLKOUT with
PLL enabled
7
5
7
6b
5
3
4
2
6a
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PDF描述 |
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