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参数资料
| 型号： | DSPIC33FJ12MC202T-I/SS |
| 厂商： | Microchip Technology |
| 文件页数： | 53/155页 |
| 文件大小： | 0K |
| 描述： | IC DSPIC MCU/DSP 12K 28SSOP |
| 产品培训模块： | Asynchronous Stimulus |
| 标准包装： | 2,100 |
| 系列： | dsPIC™ 33F |
| 核心处理器： | dsPIC |
| 芯体尺寸： | 16-位 |
| 速度： | 40 MIP |
| 连通性： | I²C，IrDA，SPI，UART/USART |
| 外围设备： | 高级欠压探测/复位，电机控制 PWM，QEI，POR，PWM，WDT |
| 输入/输出数： | 21 |
| 程序存储器容量： | 12KB（12K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 1K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 数据转换器： | A/D 6x10b/12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 28-SSOP（0.209"，5.30mm 宽） |
| 包装： | 带卷 (TR) |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页当前第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页
PIC18F2XK20/4XK20
DS41303G-page 280
2010 Microchip Technology Inc.
FIGURE 20-2:
COMPARATOR C1 SIMPLIFIED BLOCK DIAGRAM
FIGURE 20-3:
COMPARATOR C2 SIMPLIFIED BLOCK DIAGRAM
Note
1:
When C1ON = 0, the C1 comparator will produce a ‘0’ output to the XOR Gate.
2:
Output shown for reference only. See I/O port pin block diagram for more detail.
3:
Q1 and Q3 are phases of the four-phase system clock (FOSC).
4:
Q1 is held high during Sleep mode.
MUX
C1
C1POL
C1OUT
To PWM Logic
0
1
2
3
C1ON(1)
C1CH<1:0>
2
0
1
C1R
C1OE
MUX
RD_CM1CON0
Set C1IF
To
C1VIN-
C1VIN+
C12IN0-
C12IN1-
C12IN2-
C12IN3-
C1IN+
DQ
EN
Q1
Data Bus
DQ
EN
CL
Q3*RD_CM1CON0
Reset
C1OUT pin(2)
+
-
0
1
MUX
FVR
C1RSEL
CVREF
C1SP
C1VREF
MUX
C2
C2POL
C2OUT
To PWM Logic
0
1
2
3
C2ON(1)
C2CH<1:0>
2
C2OE
DQ
EN
DQ
EN
CL
RD_CM2CON0
Q3*RD_CM2CON0
Q1
Set C2IF
To
NRESET
C2VIN-
C2VIN+
C2OUT pin(2)
C12IN0-
C12IN1-
C12IN2-
C12IN3-
Data Bus
Note
1:
When C2ON = 0, the C2 comparator will produce a ‘0’ output to the XOR Gate.
2:
Output shown for reference only. See I/O port pin block diagram for more detail.
3:
Q1 and Q3 are phases of the four-phase system clock (FOSC).
4:
Q1 is held high during Sleep mode.
0
1
C2R
MUX
C2IN+
0
1
MUX
FVR
C2RSEL
CVREF
C2SP
C2VREF
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参数描述 |
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