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参数资料
| 型号： | E28F320J5-120 |
| 厂商： | INTEL CORP |
| 元件分类： | PROM |
| 英文描述： | StrataFlash MEMORY TECHNOLOGY 32 AND 64 MBIT |
| 中文描述： | 2M X 16 FLASH 5V PROM, 150 ns, PDSO56 |
| 封装： | 14 X 20 MM, TSOP-56 |
| 文件页数： | 4/51页 |
| 文件大小： | 651K |
| 代理商： | E28F320J5-120 |
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28F320J5 and 28F640J5
12
Datasheet
3.0
Bus Operation
The local CPU reads and writes flash memory in-system. All bus cycles to or from the flash
memory conform to standard microprocessor bus cycles.
NOTES:
1. See Application Note, AP-647 5 Volt Intel StrataFlash
Memory Design Guide for typical CE configurations.
2. For single-chip applications CE2 and CE1 canbestrappedtoGND.
Figure 4. Memory Map
Table 2.
Chip Enable Truth Table
CE2
CE1
CE0
DEVICE
VIL
Enabled
VIL
VIH
Disabled
VIL
VIH
VIL
Disabled
VIL
VIH
Disabled
VIH
VIL
Enabled
VIH
VIL
VIH
Enabled
VIH
VIL
Enabled
VIH
Disabled
64-Kword Block
31
1
0
63
Word Wide (x16) Mode
1FFFFF
1F0000
3FFFFF
3F0000
01FFFF
010000
00FFFF
000000
A [22-1]: 64-Mbit
A [21-1]: 32-Mbit
128-Kbyte Block
31
1
0
63
Byte-Wide (x8) Mode
3FFFFF
3E0000
7FFFFF
7E0000
03FFFF
020000
01FFFF
000000
A [22-0]: 64-Mbit
A [21-0]: 32-Mbit
32-
M
b
it
64-
M
b
it
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