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参数资料
| 型号： | EP20K100EFI784-1 |
| 厂商： | ALTERA CORP |
| 元件分类： | PLD |
| 英文描述： | LOADABLE PLD, PBGA784 |
| 文件页数： | 6/65页 |
| 文件大小： | 781K |
| 代理商： | EP20K100EFI784-1 |
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Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
Preliminary Information
Figure 6. APEX 20K Carry Chain
Cascade Chain
With the cascade chain, the APEX 20K architecture can implement
functions with a very wide fan-in. Adjacent LUTs can compute portions
of a function in parallel; the cascade chain serially connects the
intermediate values. The cascade chain can use a logical AND or logical OR
(via De Morgan’s inversion) to connect the outputs of adjacent LEs. Each
additional LE provides four more inputs to the effective width of a
function, with a short cascade delay. Cascade chain logic can be created
automatically by the Quartus Compiler during design processing, or
manually by the designer during design entry.
LUT
a1
b1
Carry Chain
s1
LE1
Register
a2
b2
Carry Chain
s2
LE2
Register
Carry Chain
s
n
LE
n
Register
a
n
b
n
Carry Chain
Carry-Out
LE
n + 1
Register
Carry-In
LUT
相关PDF资料 |
PDF描述 |
|---|---|
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| EP20K200BC784-2 | LOADABLE PLD, PBGA784 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| EP20K100EQC208-2 | 功能描述:FPGA - 现场可编程门阵列 CPLD - APEX 20K 416 Macro 151 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
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