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参数资料
| 型号： | EPF10K70 |
| 厂商： | Altera Corporation |
| 英文描述： | Embedded Programmable Logic Family(FLEX10K嵌入式可编程逻辑系列) |
| 中文描述： | 嵌入式可编程逻辑系列（FLEX10K嵌入式可编程逻辑系列） |
| 文件页数： | 14/31页 |
| 文件大小： | 299K |
| 代理商： | EPF10K70 |
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882
Altera Corporation
AN 91: Understanding FLEX 10K Timing
FLEX 10K
Timing Model
Timing models are simplified block diagrams that illustrate the
propagation delays through Altera devices. Logic can be implemented on
different paths. You can trace the actual paths used in your FLEX 10K
device by examining the equations listed in the MAX+PLUS II Report File
(
.rpt
) for your project. You can then add up the appropriate internal
timing parameters to calculate the approximate propagation delays
through the FLEX 10K device. However, the MAX+PLUS II Timing
Analyzer provides the most accurate timing information.
Figures 5
through
8
show the timing models for FLEX 10K devices.
Figure 5. FLEX 10K Device Timing Model
Dedicated
Clock/Input
Routing
I/O Element
(IOE)
Logic
Element (LE)
Embedded Array
Block (EAB)
相关PDF资料 |
PDF描述 |
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参数描述 |
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