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参数资料
| 型号： | EPF10K70 |
| 厂商： | Altera Corporation |
| 英文描述： | Embedded Programmable Logic Family(FLEX10K嵌入式可编程逻辑系列) |
| 中文描述： | 嵌入式可编程逻辑系列（FLEX10K嵌入式可编程逻辑系列） |
| 文件页数： | 16/31页 |
| 文件大小： | 299K |
| 代理商： | EPF10K70 |
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884
Altera Corporation
AN 91: Understanding FLEX 10K Timing
Figure 8. FLEX 10K Device EAB Timing Model
Calculating
Timing Delays
You can calculate approximate pin-to-pin timing delays for FLEX 10K
devices with the timing models shown in
Figures 5
through
8
and the
internal timing parameters listed in the
FLEX 10K Embedded Programmable
Logic Family Data Sheet
in this data book. Each timing delay is calculated
from a combination of internal timing parameters.
Figure 9
shows the
FLEX 10K device family LE timing delays. To calculate the delay for a
signal that follows a different path through the FLEX 10K device, refer to
the FLEX 10K timing models to determine which internal timing
parameters to add together.
EAB Data Input
Delays
t
EABDATA1
t
EABDATA2
Data-In
Address
Write Enable
Input Delays
t
EABWE1
t
EABWE2
EAB Clock
Delay
t
EABCLK
Input Register
Delays
t
EABCO
t
EABBYPASS
t
EABSU
t
EABH
t
EABCH
t
EABCL
RAM/ROM
Block Delays
t
AA
t
DD
t
WP
t
WDSU
t
WDH
t
WASU
t
WAH
t
WO
Output Register
Delays
t
EABCO
t
EABBYPASS
t
EABSU
t
EABH
t
EABCH
t
EABCL
t
EABOUT
WE
Input Register
Clock
Output Register
Clock
Data-Out
EAB Output
Delay
相关PDF资料 |
PDF描述 |
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