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参数资料
| 型号： | EPF6024A |
| 厂商： | Altera Corporation |
| 英文描述： | Programmable Logic Device Family(FLEX6000可编程逻辑系列器件) |
| 中文描述： | 可编程逻辑器件系列（FLEX6000可编程逻辑系列器件） |
| 文件页数： | 17/21页 |
| 文件大小： | 241K |
| 代理商： | EPF6024A |
Altera Corporation
935
AN 92: Understanding FLEX 6000 Timing
If
a0
is a row I/O pin, the timing delay from
a0
to
eq
can be estimated by
adding the following microparameters:
t
IN
+ t
ROW
+
t
LOCAL
+
t
DATA_TO_CASC
+
t
CASC_TO_OUT
+
t
ROW
+
t
LOCAL
+
t
OD1
Example 2: 3-Bit Adder Using a Carry Chain
FLEX 6000 devices have specialized resources that implement complex
arithmetic functions. For instance, adders and counters require a carry
function to determine whether or not to increment the next significant bit.
The FLEX 6000 architecture has a built-in carry chain that performs this
function. This example explains how to estimate the delay for a 3-bit
adder that uses a carry chain (see
Figure 6
).
Figure 6. 3-Bit Adder Implemented with a Carry Chain
b0
CARRY
a0
sum0
CARRY
b1
a1
sum1
CARRY
b2
a2
sum2
cout
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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