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参数资料
| 型号： | EPF6024AFC256-2 |
| 厂商： | ALTERA CORP |
| 元件分类： | PLD |
| 英文描述： | LOADABLE PLD, PBGA256 |
| 封装： | FINE LINE, BGA-256 |
| 文件页数： | 54/57页 |
| 文件大小： | 508K |
| 代理商： | EPF6024AFC256-2 |
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Altera Corporation
FLEX 6000 Programmable Logic Device Family Data Sheet
Figure 1. OptiFLEX Architecture Block Diagram
FLEX 6000 devices provide four dedicated, global inputs that drive the
control inputs of the flipflops to ensure efficient distribution of high-
speed, low-skew control signals. These inputs use dedicated routing
channels that provide shorter delays and lower skews than the FastTrack
Interconnect. These inputs can also be driven by internal logic, providing
an ideal solution for a clock divider or an internally generated
asynchronous clear signal that clears many registers in the device. The
dedicated global routing structure is built into the device, eliminating the
need to create a clock tree.
Logic Array Block
An LAB consists of ten LEs, their associated carry and cascade chains, the
LAB control signals, and the LAB local interconnect. The LAB provides
the coarse-grained structure of the FLEX 6000 architecture, and facilitates
efficient routing with optimum device utilization and high performance.
IOEs
Row FastTrack
Interconnect
Column FastTrack
Interconnect
Column FastTrack
Interconnect
Row FastTrack
Interconnect
Logic Elements
Local Interconnect
(Each LAB accesses
two local interconnect
areas.)
相关PDF资料 |
PDF描述 |
|---|---|
| EPF6024AFI256-2 | LOADABLE PLD, PBGA256 |
| EPF6024AFC256-3 | LOADABLE PLD, PBGA256 |
| EPL2010-102MLB | Power inductor, shielded, 20% tol, SMT, RoHS |
| EPL2010-102MLC | Power inductor, shielded, 20% tol, SMT, RoHS |
| EPL2010-103MLB | Power inductor, shielded, 20% tol, SMT, RoHS |
相关代理商/技术参数 |
参数描述 |
|---|---|
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| EPF6024AQC208-1N | 功能描述:FPGA - 现场可编程门阵列 FPGA - Flex 6000 196 LABs 171 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
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