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参数资料
| 型号： | HY5PS1G421M-E3 |
| 厂商： | HYNIX SEMICONDUCTOR INC |
| 元件分类： | DRAM |
| 英文描述： | 1Gb DDR2 SDRAM(DDP) |
| 中文描述： | 256M X 4 DDR DRAM, 0.6 ns, PBGA63 |
| 封装： | FBGA-63 |
| 文件页数： | 60/79页 |
| 文件大小： | 1109K |
| 代理商： | HY5PS1G421M-E3 |
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Rev. 0.2 / Oct. 2005
60
1
HY5PS12421(L)M
HY5PS12821(L)M
5.2.1 Input DC Logic Leve
l
5.2.2 Input AC Logic Level
5.2.3 AC Input Test Conditions
Notes:
1.
2.
Input waveform timing is referenced to the input signal crossing through the V
REF
level applied to the device under test.
The input signal minimum slew rate is to be maintained over the range from V
IL(dc)
to V
IH(ac)
min for rising edges and the range
from V
IH(dc)
to V
IL(ac)
max for falling edges as shown in the below figure.
AC timings are referenced with input waveforms switching from VIL(ac) to VIH(ac) on the positive transitions and VIH(ac) to
VIL(ac) on the negative transitions.
3.
Symbol
Parameter
Min.
Max.
Units
Notes
V
IH
(dc)
dc input logic high
V
REF
+ 0.125
V
DDQ
+ 0.3
V
V
IL
(dc)
dc input logic low
- 0.3
V
REF
- 0.125
V
Symbol
Parameter
Min.
Max.
Units
Notes
V
IH
(ac)
ac input logic high
V
REF
+ 0.250
-
V
V
IL
(ac)
ac input logic low
-
V
REF
- 0.250
V
Symbol
Condition
Value
Units
Notes
V
REF
Input reference voltage
0.5 * V
DDQ
V
1
V
SWING(MAX)
Input signal maximum peak to peak swing
1.0
V
1
SLEW
Input signal minimum slew rate
1.0
V/ns
2, 3
5.2 DC & AC Logic Input Levels
V
DDQ
V
IH(ac)
min
V
IH(dc)
min
V
REF
V
IL(dc)
max
V
IL(ac)
max
V
SS
V
SWING(MAX)
delta TR
delta TF
V
REF
-
V
IL
(ac)
max
delta TF
Falling Slew =
Rising Slew =
V
IH
(ac)
min
- V
REF
delta TR
< Figure : AC Input Test Signal Waveform>
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PDF描述 |
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参数描述 |
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