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参数资料
| 型号： | HY5PS1G821LM-E3 |
| 厂商： | HYNIX SEMICONDUCTOR INC |
| 元件分类： | DRAM |
| 英文描述： | 1Gb DDR2 SDRAM(DDP) |
| 中文描述： | 128M X 8 DDR DRAM, 0.6 ns, PBGA63 |
| 封装： | FBGA-63 |
| 文件页数： | 18/79页 |
| 文件大小： | 1109K |
| 代理商： | HY5PS1G821LM-E3 |
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Rev. 0.2 / Oct. 2005
18
1
HY5PS12421(L)M
HY5PS12821(L)M
2.3.2.3 Off-Chip Driver (OCD) Impedance Adjustment
DDR2 SDRAM supports driver calibration feature and the flow chart below is an example of sequence. Every
calibration mode command should be followed by “OCD calibration mode exit” before any other command
being issued.
MRS should be set before entering OCD impedance adjustment and ODT (On Die Termian-
tion) should be carefully controlled depending on system environment.
Start
EMRS: Drive(1)
DQ & DQS High; DQS Low
Test
EMRS :
Enter Adjust Mode
BL=4 code input to all DQs
Inc, Dec, or NOP
EMRS: Drive(0)
DQ & DQS Low; DQS High
Test
EMRS :
Enter Adjust Mode
BL=4 code input to all DQs
Inc, Dec, or NOP
EMRS: OCD calibration mode exit
End
ALL OK
ALL OK
Need Calibration
Need Calibration
EMRS: OCD calibration mode exit
EMRS: OCD calibration mode exit
EMRS: OCD calibration mode exit
EMRS: OCD calibration mode exit
EMRS: OCD calibration mode exit
MRS shoud be set before entering OCD impedance adjustment and ODT should
be carefully controlled depending on system environment
相关PDF资料 |
PDF描述 |
|---|---|
| HY5PS1G821M | 1Gb DDR2 SDRAM(DDP) |
| HY5PS1G821M-C4 | 1Gb DDR2 SDRAM(DDP) |
| HY5PS1G821M-E3 | 1Gb DDR2 SDRAM(DDP) |
| HY5PS1G421LM | 1Gb DDR2 SDRAM(DDP) |
| HY5PS1G421LM-C4 | 1Gb DDR2 SDRAM(DDP) |
相关代理商/技术参数 |
参数描述 |
|---|---|
| HY5PS1G821M | 制造商:HYNIX 制造商全称:Hynix Semiconductor 功能描述:1Gb DDR2 SDRAM(DDP) |
| HY5PS1G821M-C4 | 制造商:HYNIX 制造商全称:Hynix Semiconductor 功能描述:1Gb DDR2 SDRAM(DDP) |
| HY5PS1G821M-E3 | 制造商:HYNIX 制造商全称:Hynix Semiconductor 功能描述:1Gb DDR2 SDRAM(DDP) |
| HY5PS1G831AFP | 制造商:HYNIX 制造商全称:Hynix Semiconductor 功能描述:1Gb DDR2 SDRAM |
| HY5PS1G831AFP-C4 | 制造商:HYNIX 制造商全称:Hynix Semiconductor 功能描述:1Gb DDR2 SDRAM |
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