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参数资料
| 型号： | ICS1893BKILF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 92/133页 |
| 文件大小： | 0K |
| 描述： | PHYCEIVER LOW PWR 3.3V 56-VQFN |
| 标准包装： | 260 |
| 系列： | PHYceiver™ |
| 类型： | PHY 收发器 |
| 规程： | MII |
| 电源电压： | 3.14 V ~ 3.47 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 56-VFQFN 裸露焊盘 |
| 供应商设备封装： | 56-VFQFP-EP（8x8） |
| 包装： | 管件 |
| 其它名称： | 1893BKILF 800-2354-5 ICS1893BKILF-ND |
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Chapter 7 Management Register Set
ICS1893BF, Rev. F, 5/13/10
May, 2010
61
ICS1893BF Data Sheet Rev. F - Release
Copyright 2009, IDT, Inc.
All rights reserved.
7.3.12 Jabber Detect (bit 1.1)
The purpose of this bit is to allow an STA to determine if the ICS1893BF detects a Jabber condition as
defined in the ISO/IEC specification.The ICS1893BF Jabber Detection function is controlled by the Jabber
Inhibit bit in the 10Base-T Operations register (bit 18.5). To detect a Jabber condition, first the ICS1893BF
Jabber Detection function must be enabled. When bit 18.5 is logic:
Zero, the ICS1893BF disables Jabber Detection and sets the Jabber Detect bit to logic zero.
One, the ICS1893BF enables Jabber Detection and sets the Jabber Detect bit to logic one upon
detection of a Jabber condition. When no Jabber condition is detected, the Jabber Detect bit is not
altered.
Note:
1. The Jabber Detect bit is accessible through both the Status register (as bit 1.1) and the QuickPoll
Detailed Status Register (as bit 17.2). A read of either register clears the Jabber Detect bit.
2. The Jabber Detect bit is a latching high (LH) bit. (For more information on latching high and latching low
7.3.13 Extended Capability (bit 1.0)
The STA reads bit 1.0 to determine if the ICS1893BF has an extended register set. In the ICS1893BF this
bit is always logic one, indicating that it has extended registers.
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PDF描述 |
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| VE-25K-MY-B1 | CONVERTER MOD DC/DC 40V 50W |
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参数描述 |
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