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参数资料
| 型号： | ICS9FG1901HKLFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 1/18页 |
| 文件大小： | 0K |
| 描述： | IC FREQUENCY GENERATOR 72-QFN |
| 标准包装： | 1 |
| 系列： | PCI Express® (PCIe) |
| 类型： | 时钟/频率发生器 |
| PLL： | 是 |
| 主要目的： | 存储器，DIMM，PCI Express（PCIe） |
| 输入： | HCSL |
| 输出： | HCSL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:19 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 400MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 72-VFQFN 裸露焊盘 |
| 供应商设备封装： | 72-VFQFPN（10x10） |
| 包装： | 标准包装 |
| 产品目录页面： | 1251 (CN2011-ZH PDF) |
| 其它名称： | 800-1264-6 |
9FG1901H
IDTTM
Frequency Gearing Clock for CPU, PCIe Gen1 & FBD
1386A - 02/02/10
Frequency Gearing Clock for CPU, PCIe Gen1 & FBD
DATASHEET
1
Description
The 9FG1901H follows the Intel DB1900G Differential Buffer
Specification. This buffer provides 19 output clocks for CPU Host
Bus, PCI-Express, or Fully Buffered DIMM applications. The outputs
are configured with two groups. Both groups, DIF_(16:0) and
DIF_(18:17) can be equal to or have a gear ratio to the input clock.
A differential CPU clock from a CK410B+ main clock generator,
such as the ICS932S421, drives the ICS9FG1901. The 9FG1901H
can provide outputs up to 400MHz.
Key Specifications
DIF output cycle-to-cycle jitter < 50ps
DIF output-to-output skew across all outputs in 1:1 mode < 150ps
Features/Benefits
Power up default is all outputs in 1:1 mode
DIF_(16:0) can be “gear-shifted” from the input CPU Host
Clock
DIF_(18:17) can be “gear-shifted” from the input CPU Host
Clock
Spread spectrum compatible
Supports output clock frequencies up to 400 MHz
8 Selectable SMBus addresses
SMBus address determines PLL or Bypass mode
VDDA controlled power down mode
Functional Block Diagram
STOP
LOGIC
CLK_IN
CLK_IN#
DIF(16:0)
CONTROL
LOGIC
HIGH_BW#
SMB_A2_PLLBYP#
SMBDAT
SMBCLK
SPREAD
COMPATIBLE
PLL
17
IREF
OE(16:5)#,
OE_01234#
13
SMB_A0
SMB_A1
FS_A_410
STOP
LOGIC
DIF(18:17)
2
OE_17_18#
GEAR
SHIFT
LOGIC
SPREAD
COMPATIBLE
PLL
GEAR
SHIFT
LOGIC
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