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参数资料
| 型号： | ICS9FG1901HKLFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 2/18页 |
| 文件大小： | 0K |
| 描述： | IC FREQUENCY GENERATOR 72-QFN |
| 标准包装： | 1 |
| 系列： | PCI Express® (PCIe) |
| 类型： | 时钟/频率发生器 |
| PLL： | 是 |
| 主要目的： | 存储器，DIMM，PCI Express（PCIe） |
| 输入： | HCSL |
| 输出： | HCSL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:19 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 400MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 72-VFQFN 裸露焊盘 |
| 供应商设备封装： | 72-VFQFPN（10x10） |
| 包装： | 标准包装 |
| 产品目录页面： | 1251 (CN2011-ZH PDF) |
| 其它名称： | 800-1264-6 |
IDTTM
Frequency Gearing Clock for CPU, PCIe Gen1 & FBD
1386A - 02/02/10
9FG1901H
Frequency Gearing Clock for CPU, PCIe Gen1 & FBD
10
SMBusTable: Control Pin Readback Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
R
X
Bit 6
X
Bit 5
X
Bit 4
DIF_18
Output Control
RW
Hi-Z
Enable
1
Bit 3
DIF_17
Output Control
RW
Hi-Z
Enable
1
Bit 2
DIF_16
Output Control
RW
Hi-Z
Enable
1
Bit 1
DIF_15
Output Control
RW
Hi-Z
Enable
1
Bit 0
DIF_14
Output Control
RW
Hi-Z
Enable
1
SMBusTable: 1:1 PLL Operating Set Point Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
0
Bit 6
0
Bit 5
0
Bit 4
0
Bit 3
0
Bit 2
RW
x
Bit 1
RW
1
Bit 0
RW
Latch
RESERVED
Frequency Select C
See ICS9FG1901H 1:1 PLL
Programming Table
Frequency Select B
FS_A_410
Byte 9
-
RESERVED
Byte 8
5
Readback - FS_A_410
Readback
RESERVED
Byte 9,
bit 2
FSC
Byte 9,
bit 1
FSB
Byte 9,
bit 0
FS_A_410
CLK_IN
(CPU FSB)
MHz
1:1 DIF
Outputs
MHz
Notes
1
0
1
100.00
3
0
1
133.33
3
0
1
166.67
1
0
1
0
200.00
3
0
266.67
3
1
0
333.33
3
1
0
400.00
2
1
Notes:FS_A_410 = 1
1. Powerup Default for FS_A_410 = 1
2. Powerup Default for FS_A_410 = 0
3. Setting the exact FSB frequency after Power is required to meet phase jitter specs.
Reserved
9FG1901H 1:1 PLL Programming
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