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参数资料
| 型号： | ICS9FG1901HKLFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 3/18页 |
| 文件大小： | 0K |
| 描述： | IC FREQUENCY GENERATOR 72-QFN |
| 标准包装： | 1 |
| 系列： | PCI Express® (PCIe) |
| 类型： | 时钟/频率发生器 |
| PLL： | 是 |
| 主要目的： | 存储器，DIMM，PCI Express（PCIe） |
| 输入： | HCSL |
| 输出： | HCSL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:19 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 400MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 72-VFQFN 裸露焊盘 |
| 供应商设备封装： | 72-VFQFPN（10x10） |
| 包装： | 标准包装 |
| 产品目录页面： | 1251 (CN2011-ZH PDF) |
| 其它名称： | 800-1264-6 |
IDTTM
Frequency Gearing Clock for CPU, PCIe Gen1 & FBD
1386A - 02/02/10
9FG1901H
Frequency Gearing Clock for CPU, PCIe Gen1 & FBD
11
Absolute Maximum Ratings
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS Notes
3.3V Core Supply Voltage
VDD_A
GND - 0.5
VDD + 0.5V
V
1
3.3V Logic Supply Voltage
VDD_In
GND - 0.5
VDD + 0.5V
V
1
Storage Temperature
Ts
-65
150
°C
1
Ambient Operating Temp
Tambient
0
70
°C
1
Case Temperature
Tcase
115
°C
1
Input ESD protection
ESD prot
Human Body Model
2000
V
1
Electrical Characteristics - Input/Supply/Common Output Parameters
TA = 0 - 70°C; Supply Voltage VDD = 3.3 V +/-5%
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS Notes
Input High Voltage
VIH
3.3 V +/-5%, Except CLK_IN
2
VDD + 0.3
V
1
Input Low Voltage
VIL
3.3 V +/-5%, Except CLK_IN
VSS - 0.3
0.8
V
1
Input High Current
IIH
VIN = VDD
-5
5
uA
Input Low Current
IIL1
VIN = 0 V; Inputs with no pull-
up resistors
-5
uA
Low Threshold Input-
High Voltage
VIH_FS
3.3 V +/-5%, Applies to
FS_A_410 pin
0.7
VDD + 0.3
V
1
Low Threshold Input-
Low Voltage
VIL_FS
3.3 V +/-5%, Applies to
FS_A_410 pin
VSS - 0.3
0.35
V
1
Operating Current
IDD3.3OP
all outputs driven
600
mA
1
Powerdown Current
IDD3.3PD
all differential pairs tri-stated
36
mA
1
Input Frequency
Fi
VDD = 3.3 V
100
400
MHz
3
Pin Inductance
Lpin
7
nH
1
CIN
Logic Inputs
6
pF
1
COUT
Output pin capacitance
5
pF
1
Clk Stabilization
TSTAB
From VDD Power-Up or de-
assertion of PD# to 1st clock
1.8
ms
1
Modulation Frequency
Triangular Modulation
30
33
kHz
1
Tdrive_PD#
DIF output enable after
PD# de-assertion
300
us
1
Tfall_Pd#
PD# fall time of
5
ns
1
Trise_Pd#
PD# rise time of
5
ns
2
SMBus Voltage
VMAX
Maximum input voltage
5.5
V
1
Low-level Output Voltage
VOL
@ IPULLUP
0.4
V
1
Current sinking at
VOL = 0.4 V
IPULLUP
4
mA
1
SCLK/SDATA
Clock/Data Rise Time
TRI2C
(Max VIL - 0.15) to
(Min VIH + 0.15)
1000
ns
1
SCLK/SDATA
Clock/Data Fall Time
TFI2C
(Min VIH + 0.15) to
(Max VIL - 0.15)
300
ns
1
Input Capacitance
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