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参数资料
| 型号： | ICS9FG1901HKLFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 17/18页 |
| 文件大小： | 0K |
| 描述： | IC FREQUENCY GENERATOR 72-QFN |
| 标准包装： | 1 |
| 系列： | PCI Express® (PCIe) |
| 类型： | 时钟/频率发生器 |
| PLL： | 是 |
| 主要目的： | 存储器，DIMM，PCI Express（PCIe） |
| 输入： | HCSL |
| 输出： | HCSL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:19 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 400MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 72-VFQFN 裸露焊盘 |
| 供应商设备封装： | 72-VFQFPN（10x10） |
| 包装： | 标准包装 |
| 产品目录页面： | 1251 (CN2011-ZH PDF) |
| 其它名称： | 800-1264-6 |
IDTTM
Frequency Gearing Clock for CPU, PCIe Gen1 & FBD
1386A - 02/02/10
9FG1901H
Frequency Gearing Clock for CPU, PCIe Gen1 & FBD
8
SMBusTable: FSB Frequency Select Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
GRSEL_17
Group of 17 gear ratio select
RW
Gear Ratio
1:1
1
Bit 6
GRSEL_2
Group of 2 gear ratio select
RW
Gear Ratio
1:1
1
Bit 5
X
Bit 4
RW
Latch
Bit 3
FSBG_3
FSB Gear Ratio FS_3
RW
x
Bit 2
FSBG_2
FSB Gear Ratio FS_2
RW
0
Bit 1
FSBG_1
FSB Gear Ratio FS_1
RW
x
Bit 0
FSBG_0
FSB Gear Ratio FS_0
RW
1
SMBusTable: Output Control Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
DIF_7
Output Control
RW
Hi-Z
Enable
1
Bit 6
DIF_6
Output Control
RW
Hi-Z
Enable
1
Bit 5
DIF_5
Output Control
RW
Hi-Z
Enable
1
Bit 4
DIF_4
Output Control
RW
Hi-Z
Enable
1
Bit 3
DIF_3
Output Control
RW
Hi-Z
Enable
1
Bit 2
DIF_2
Output Control
RW
Hi-Z
Enable
1
Bit 1
DIF_1
Output Control
RW
Hi-Z
Enable
1
Bit 0
DIF_0
Output Control
RW
Hi-Z
Enable
1
SMBusTable: Output and PLL BW Control Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
RW
High BW
Low BW
1
Bit 6
RW
Bypass
PLL
1
Bit 5
DIF_13
Output Control
RW
Hi-Z
Enable
1
Bit 4
DIF_12
Output Control
RW
Hi-Z
Enable
1
Bit 3
DIF_11
Output Control
RW
Hi-Z
Enable
1
Bit 2
DIF_10
Output Control
RW
Hi-Z
Enable
1
Bit 1
DIF_9
Output Control
RW
Hi-Z
Enable
1
Bit 0
DIF_8
Output Control
RW
Hi-Z
Enable
1
Note: Bit 7 is wired OR to the HIGH_BW# input, any 0 selects High BW
Note: Bit 6 is wired OR to the SMB_A2_PLLBYP# input, any 0 selects Fanout Bypass mode
SMBusTable: Output Enable Readback Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
R
X
Bit 6
R
X
Bit 5
R
X
Bit 4
R
X
Bit 3
R
X
Bit 2
R
X
Bit 1
R
X
Bit 0
R
X
Readback
Readback - OE_01234# Input
Readback
Readback - OE5# Input
Readback - OE6# Input
Readback
see note
PLL_BW# adjust
Readback - OE7# Input
-
Byte 1
Byte 0
DIF(16:0)
DIF(18:17)
FS_A_410 Latched Input
-
Reserved
See ICS9FG1901
Programmable Gear Ratios
Table
-
8
72
Readback - OE9# Input
Readback - OE8# Input
see note
BYPASS# test mode / PLL
Byte 3
Byte 2
Readback - HIGH_BW# In
Readback
Readback - SMB_A2_PLLBYP# In
Readback
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