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参数资料
| 型号： | IDT5V49EE702NDGI |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 24/34页 |
| 文件大小： | 0K |
| 描述： | IC PLL CLK GEN 200MHZ 28VQFN |
| 产品培训模块： | VersaClock™ III Programmable Clocks |
| 特色产品： | VersaClock III Timing Devices |
| 标准包装： | 75 |
| 系列： | VersaClock™ III |
| 类型： | 时钟发生器，多路复用器 |
| PLL： | 带旁路 |
| 输入： | LVCMOS，LVTTL，晶体 |
| 输出： | HCSL，LVCMOS，LVDS，LVPECL，LVTTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:7 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 500MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 28-VFQFN 裸露焊盘 |
| 供应商设备封装： | 28-VFQFPN（4x4） |
| 包装： | 管件 |
| 其它名称： | 800-1918 IDT5V49EE702DLGI |
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IDT5V49EE702
EEPROM PROGRAMMABLE CLOCK GENERATOR
CLOCK SYNTHESIZER
IDT EEPROM PROGRAMMABLE CLOCK GENERATOR
30
IDT5V49EE702
REV M 092412
Default Configuration: OUT1 = Reference Clock output, all other outputs turned off.
1. Memory bytes do not exist. Readback will be last value in shift register. If reading sequentially, value in 0x51 will be
returned.
0xCA
49
SRC6[2:0]_CFG4
SRC5[2:0]_CFG4
Reserved
SRC6
000 - Reserved
001 - Reserved
010 - Reference input
011 - Reserved
100 - Reserved
101 - PLL1
110 - Reserved
111 - Reserved
Quiet MUX
0xCB
49
SRC6[2:0]_CFG5
SRC5[2:0]_CFG5
0xCC
49
SRC6[2:0]_CFG0
SRC5[2:0]_CFG0
0xCD
49
SRC6[2:0]_CFG1
SRC5[2:0]_CFG1
0xCE
49
SRC6[2:0]_CFG2
SRC5[2:0]_CFG2
0xCF
49
SRC6[2:0]_CFG3
SRC5[2:0]_CFG3
Addr
Default
Register
Hex
Value
Bit #
Description
76
5
4
3
2
1
0
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PDF描述 |
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参数描述 |
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