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参数资料
| 型号： | IDT5V49EE702NDGI |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 30/34页 |
| 文件大小： | 0K |
| 描述： | IC PLL CLK GEN 200MHZ 28VQFN |
| 产品培训模块： | VersaClock™ III Programmable Clocks |
| 特色产品： | VersaClock III Timing Devices |
| 标准包装： | 75 |
| 系列： | VersaClock™ III |
| 类型： | 时钟发生器，多路复用器 |
| PLL： | 带旁路 |
| 输入： | LVCMOS，LVTTL，晶体 |
| 输出： | HCSL，LVCMOS，LVDS，LVPECL，LVTTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:7 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 500MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 28-VFQFN 裸露焊盘 |
| 供应商设备封装： | 28-VFQFPN（4x4） |
| 包装： | 管件 |
| 其它名称： | 800-1918 IDT5V49EE702DLGI |
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IDT5V49EE702
EEPROM PROGRAMMABLE CLOCK GENERATOR
CLOCK SYNTHESIZER
IDT EEPROM PROGRAMMABLE CLOCK GENERATOR
5
IDT5V49EE702
REV M 092412
PLL Features and Descriptions
PLL0 Block Diagram
PLL1, PLL2 and PLL3 Block Diagram
VC O
N
D
A
Sigm a-D elta
Modulator
12-bit
7-bit
4-bit
VCO
N
D
12-bit
7-bit
Pre-Divider
(D)1 Values
Multiplier
(M)2 Values
Programmable
Loop Bandwidth
Spread Spectrum
Generation Capability
PLL0
1 - 127
10 - 8206
Yes
PLL1
1 - 127
1 - 4095
Yes
No
PLL2
1 - 127
1 - 4095
Yes
No
PLL3
3 - 127
12 - 4095
Yes
1.For PLL0, PLL1 and PLL2, D=0 means PLL power down. For PLL3, 0, 1, and 2 are DNU (do not use)
2.For PLL0, M = 2*N + A + 1 (for A > 0); M = 2*N (for A = 0); A < N-1. For PLL1, PLL2 and PLL3, M=N.
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PDF描述 |
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