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参数资料
| 型号： | IDT70T653MS12BCI |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 10/24页 |
| 文件大小： | 0K |
| 描述： | IC SRAM 18MBIT 12NS 256BGA |
| 标准包装： | 12 |
| 格式 - 存储器： | RAM |
| 存储器类型： | SRAM - 双端口，异步 |
| 存储容量： | 18M（512K x 36） |
| 速度： | 12ns |
| 接口： | 并联 |
| 电源电压： | 2.4 V ~ 2.6 V |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 256-LBGA |
| 供应商设备封装： | 256-CABGA（17x17） |
| 包装： | 托盘 |
| 其它名称： | 70T653MS12BCI 800-2604 IDT70T653MS12BCI-ND |
IDT70T653M
High-Speed 2.5V 512K x 36 Asynchronous Dual-Port Static RAM
Waveform of Read Cycles (4)
t RC
ADDR
Industrial and Commercial Temperature Ranges
t AA
(3)
CE
(5)
t ACE
t AOE
(3)
(3)
OE
t ABE (3)
BE n
R/ W
t LZ /t LZOB
(1)
t OH
DATA OUT
VALID DATA
(3)
t HZ
(2)
.
5679 drw 06
NOTES:
1. Timing depends on which signal is asserted last, OE , CE or BE n.
2. Timing depends on which signal is de-asserted first CE , OE or BE n.
3. Start of valid data depends on which timing becomes effective last t AOE , t ACE , t AA or t ABE .
4. SEM = V IH .
5. CE = L occurs when CE 0 = V IL and CE 1 = V IH . CE = H when CE 0 = V IH and/or CE 1 = V IL .
Timing of Power-Up Power-Down
CE
I CC
t PU
t PD
I SB
50%
50%
5679 drw 07
.
10
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PDF描述 |
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参数描述 |
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| IDT70T653MS15BC8 | 功能描述:IC SRAM 18MBIT 15NS 256BGA RoHS:否 类别:集成电路 (IC) >> 存储器 系列:- 标准包装:3,000 系列:- 格式 - 存储器:EEPROMs - 串行 存储器类型:EEPROM 存储容量:8K (1K x 8) 速度:400kHz 接口:I²C，2 线串口 电源电压:1.7 V ~ 5.5 V 工作温度:-40°C ~ 85°C 封装/外壳:8-SOIC（0.154"，3.90mm 宽） 供应商设备封装:8-SOIC 包装:带卷 (TR) |
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| IDT70T659S10BC8 | 功能描述:IC SRAM 4MBIT 10NS 256BGA RoHS:否 类别:集成电路 (IC) >> 存储器 系列:- 标准包装:3,000 系列:- 格式 - 存储器:EEPROMs - 串行 存储器类型:EEPROM 存储容量:8K (1K x 8) 速度:400kHz 接口:I²C，2 线串口 电源电压:1.7 V ~ 5.5 V 工作温度:-40°C ~ 85°C 封装/外壳:8-SOIC（0.154"，3.90mm 宽） 供应商设备封装:8-SOIC 包装:带卷 (TR) |
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