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参数资料
| 型号： | IDT72V2113L10PFI8 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 36/46页 |
| 文件大小： | 0K |
| 描述： | IC FIFO SUPERSYNCII 10NS 80-TQFP |
| 标准包装： | 750 |
| 系列： | 72V |
| 功能： | 同步 |
| 存储容量： | 4.7Mb（262k x 18） |
| 访问时间： | 10ns |
| 电源电压： | 3.15 V ~ 3.45 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 80-LQFP |
| 供应商设备封装： | 80-TQFP（14x14） |
| 包装： | 带卷 (TR) |
| 其它名称： | 72V2113L10PFI8 |
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IDT72V263/273/283/293/103/113 3.3V HIGH DENSITY SUPERSYNC IITM NARROW BUS FIFO
8K x 18, 16K x 9/18, 32K x 9/18, 64K x 9/18, 128K x 9/18, 256K x 9/18, 512K x9
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72V2103/72V2113 3.3V HIGH DENSITY SUPERSYNC IITM NARROW BUS FIFO
131,072 x 18/262,144 x 9, 262,144 x 18/524,288 x 9
JUNE 1, 2010
Figure 31. Standard JTAG Timing
SYSTEM INTERFACE PARAMETERS
Parameter
Symbol
Test
Conditions
Min.
Max. Units
JTAG Clock Input Period tTCK
-
100
-
ns
JTAG Clock HIGH
tJTCKH
-40
-
ns
JTAG Clock Low
tJTCKL
-40
-
ns
JTAG Clock Rise Time
tJTCKR
--
5(1)
ns
JTAG Clock Fall Time
tJTCKF
--
5(1)
ns
JTAG Reset
tJRST
-50
-
ns
JTAG Reset Recovery
tJRSR
-50
-
ns
JTAG AC ELECTRICAL
CHARACTERISTICS
(VCC = 3.3V
± 5%; Tcase = 0°C to +85°C)
NOTE:
1. 50pf loading on external output signals.
NOTE:
1. Guaranteed by design.
tDS
tDH
TDO
TDI/
TMS
TCK
TRST(1)
tDO
6119 drw34
tJRSR
tJRST
tTCK
tJTCKR
tJTCKH
tJTCKL
tJTCKF
IDT72V2103
IDT72V2113
Parameter
Symbol
Test Conditions
Min.
Max.
Units
DataOutput
tDO(1)
-20
ns
Data Output Hold
tDOH(1)
0-
ns
Data Input
tDS
trise=3ns
10
-
ns
tDH
tfall=3ns
10
-
NOTE:
1. During power up,
TRST could be driven low or not be used since the JTAG circuit resets automatically. TRST is an optional JTAG reset.
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PDF描述 |
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