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参数资料
| 型号： | IDT82V2608BB |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | INVERSE MULTIPLEXING FOR ATM |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA208 |
| 封装： | PLASTIC, BGA-208 |
| 文件页数： | 26/98页 |
| 文件大小： | 398K |
| 代理商： | IDT82V2608BB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页当前第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页
INTERFACE
26
December 4, 2006
IDT82V2608
Inverse Multiplexing for ATM
Table-9 FIFO Interrupt Enable Register (FIFO_INT_ENABLE_REG)
(R/W, Address=04H)
Symbol
Position
Default
Description
-
7-3
0
Reserved.
Input_FIFO_empty_int_en
2
0
Input FIFO empty interrupt enable
0: Interrupt disabled
1: Interrupt enabled
Input_FIFO_overflow_int_en
1
0
Input FIFO overflow interrupt enable
0: Interrupt disabled
1: Interrupt enabled
Output_FIFO_msg_available_int_en
0
0
Output FIFO message available interrupt enable
0: Interrupt disabled
1: Interrupt enabled
Table-10 FIFO Interrupt Status Register (FIFO_STATE_REG)
(R, Address=05H)
Symbol
Position
Default
Description
HW_version
7-3
1
Current device version. For revision A and B, these bits are ‘0000’. For revision C, these bits are
‘0001’.
Input_FIFO_empty_state
2
1
Input FIFO availability status
0: Input FIFO is not available for writing.
1: Input FIFO is available for writing.
Input_FIFO_overflow_state
1
0
Input FIFO overflow status
0: Input FIFO is not full.
1: Input FIFO is full.
Output_FIFO_msg_available_state
0
0
Output FIFO message availability status
0: No message is in the Output FIFO.
1: A message is in the Output FIFO.
Table-11 FIFO Interrupt Reset Register (FIFO_INT_RESET_REG)
(W, Address=06H)
Symbol
Position
Default
Description
-
7-2
0
Reserved.
Input_FIFO_overflow&empty_int_rst
1
0
Write ‘1’ to clear the Input_FIFO_overflow_state status and Input_FIFO_empty_state status.
Output_FIFO_msg_available_int_rst
0
0
Write ‘1’ to clear the Output_FIFO_msg_available_state status.
Table-12 Output FIFO Internal State Register (OUTPUT_FIFO_INTERNAL_STATE_REG)
(R, Address=07H)
Symbol
Position
Default
Description
-
7-5
0
Reserved.
Output_remain_msg_length[4:0]
4-0
0
The length of the message remaining in the Output FIFO to be read by the external mcroproces-
sor.
相关PDF资料 |
PDF描述 |
|---|---|
| IDT82V2608 | INVERSE MULTIPLEXING FOR ATM |
| IDT82V3001A | WAN PLL WITH SINGLE REFERENCE INPUT |
| IDT82V3001APV | WAN PLL WITH SINGLE REFERENCE INPUT |
| IDT82V3002A | WAN PLL WITH DUAL REFERENCE INPUTS |
| IDT82V3002APV | WAN PLL WITH DUAL REFERENCE INPUTS |
相关代理商/技术参数 |
参数描述 |
|---|---|
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| IDT82V2616 | 制造商:IDT 制造商全称:Integrated Device Technology 功能描述:INVERSE MULTIPLEXING FOR ATM |
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| IDT82V3001A | 制造商:IDT 制造商全称:Integrated Device Technology 功能描述:WAN PLL WITH SINGLE REFERENCE INPUT |
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