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参数资料
| 型号： | IDT82V3255TF |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 通信及网络 |
| 英文描述： | WAN PLL |
| 中文描述： | SPECIALTY TELECOM CIRCUIT, PQFP64 |
| 封装： | TQFP-64 |
| 文件页数： | 43/127页 |
| 文件大小： | 868K |
| 代理商： | IDT82V3255TF |
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IDT82V3255
WAN PLL
Microprocessor Interface
43
June 19, 2006
4
MICROPROCESSOR INTERFACE
The microprocessor interface provides access to read and write the
registers in the device. The microprocessor interface supports Serial
mode only.
In a read operation, the active edge of SCLK is selected by CLKE.
When CLKE is asserted low, data on SDO will be clocked out on the ris-
ing edge of SCLK. When CLKE is asserted high, data on SDO will be
clocked out on the falling edge of SCLK.
In a write operation, data on SDI will be clocked in on the rising edge
of SCLK.
Figure 14. Serial Read Timing Diagram (CLKE Asserted Low)
Figure 15. Serial Read Timing Diagram (CLKE Asserted High)
CS
SCLK
SDI
SDO
High-Z
D0
D1
D2
D3
D4
D5
D6
D7
t
pw2
t
pw1
t
su2
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su1
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h1
t
h2
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d1
t
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R/
W
A0
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CS
SCLK
SDI
SDO
High-Z
R/
W
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