参数资料
| 型号： | IP-NIOS |
| 厂商： | Altera |
| 文件页数： | 46/288页 |
| 文件大小： | 0K |
| 描述： | IP NIOS II MEGACORE |
| 标准包装： | 1 |
| 类型： | 许可证 |
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3–6
Chapter 3: Programming Model
Memory Management Unit
TLB Organization
A TLB functions as a cache for the operating system’s page table. In Nios II processors
with an MMU, one main TLB is shared by instruction and data accesses. The TLB is
stored in on-chip RAM and handles translations for instruction fetches and
instructions that perform data accesses.
The TLB is organized as an n -way set-associative cache. The software specifies the
way (set) when loading a new entry.
1
You can configure the number of TLB entries and the number of ways (set
associativity) of the TLB with the Nios II Processor parameter editor in Qsys. By
default, the TLB is a 16-way cache. The default number of entries depends on the
target device, as follows:
■
■
Cyclone ? II, Stratix ? II, Stratix II GX—128 entries, requiring one M4K RAM
Cyclone III, Stratix III, Stratix IV—256 entries, requiring one M9K RAM
For more information, refer to the Instantiating the Nios II Processor chapter of
the Nios II Processor Reference Handbook .
The operating system software is responsible for guaranteeing that multiple TLB
entries do not map the same virtual address. The hardware behavior is undefined
when multiple entries map the same virtual address.
Each TLB entry consists of a tag and data portion. This is analogous to the tag and
data portion of instruction and data caches.
f Refer to the Nios II Core Implementation Details chapter of the Nios II Processor Reference
Handbook for information about instruction and data caches.
The tag portion of a TLB entry contains information used when matching a virtual
address to a TLB entry.
Table 3–3. TLB Tag Portion Contents
Field Name
VPN
PID
G
Nios II Processor Reference Handbook
Description
VPN is the virtual page number field. This field is compared with the top 20 bits of
the virtual address.
PID is the process identifier field. This field is compared with the value of the
current process identifier stored in the tlbmisc control register, effectively
extending the virtual address. The field size is configurable in the Nios_II
Processor parameter editor, and can be between 8 and 14 bits.
G is the global flag. When G = 1, the PID is ignored in the TLB lookup.
February 2014 Altera Corporation
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PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
| IPO-002-VSF-LF | 制造商:PROXISTOR AB ELECTRONIC 功能描述:PROXIMITY SWITCH, PNP; Sensor Input:Inductive; Sensing Range Max:2mm; Supply Voltage DC Min:10V; Supply Voltage DC Max:30V; SVHC:No SVHC (19-Dec-2012); External Depth:10.5mm; External Length / Height:16.5mm; External Width:30mm; |
| IPOD TOUCH4-C-B | 制造商:Distributed By MCM 功能描述:Apple® iPod Black Touch 4th Gen Digitizer + Glass 制造商:Distributed By MCM 功能描述:APPLE IPOD TOUCH DIGITIZER BLACK |
| IPOD TOUCH4-C-W | 制造商:Distributed By MCM 功能描述:APPLE IPOD TOUCH DIGITIZER WHITE 制造商:Distributed By MCM 功能描述:Apple® iPod White Touch 4th Gen Digitizer + Glass |
| IPP015N04N G | 功能描述:MOSFET OptiMOS 3 PWR TRANST 40V 120A RoHS:否 制造商:STMicroelectronics 晶体管极性:N-Channel 汲极/源极击穿电压:650 V 闸/源击穿电压:25 V 漏极连续电流:130 A 电阻汲极/源极 RDS（导通）:0.014 Ohms 配置:Single 最大工作温度: 安装风格:Through Hole 封装 / 箱体:Max247 封装:Tube |
| IPP015N04NG | 制造商:Infineon Technologies AG 功能描述: |
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