参数资料
型号: IP-NIOS
厂商: Altera
文件页数: 9/288页
文件大小: 0K
描述: IP NIOS II MEGACORE
标准包装: 1
类型: 许可证
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1. Introduction
February 2014
NII51001-13.1.0
NII51001-13.1.0
This handbook describes the Nios II processor from a high-level conceptual
description to the low-level details of implementation. The chapters in this handbook
describe the Nios II processor architecture, the programming model, and the
instruction set.
f This handbook is the primary reference for the Nios ? II family of embedded
processors and is part of a larger collection of documents covering the Nios II
processor and its usage that you can find on the Literature: Nios II Processor page of
the Altera ? website.
This handbook assumes you have a basic familiarity with embedded processor
concepts. You do not need to be familiar with any specific Altera technology or with
Altera development tools. This handbook limits discussion of hardware
implementation details of the processor system. The Nios II processors are designed
for Altera FPGA devices, and so this handbook does describe some FPGA
implementation concepts. Your familiarity with FPGA technology provides a deeper
understanding of the engineering trade-offs related to the design and implementation
of the Nios II processor.
This chapter introduces the Altera Nios II embedded processor family and describes
the similarities and differences between the Nios II processor and traditional
embedded processors.
Nios II Processor System Basics
The Nios II processor is a general-purpose RISC processor core with the following
features:
Full 32-bit instruction set, data path, and address space
32 general-purpose registers
Optional shadow register sets
32 interrupt sources
External interrupt controller interface for more interrupt sources
Single-instruction 32 × 32 multiply and divide producing a 32-bit result
Dedicated instructions for computing 64-bit and 128-bit products of multiplication
Optional floating-point instructions for single-precision floating-point operations
Single-instruction barrel shifter
Access to a variety of on-chip peripherals, and interfaces to off-chip memories and
peripherals
Hardware-assisted debug module enabling processor start, stop, step, and trace
under control of the Nios II software development tools
? 2014 Altera Corporation. All rights reserved. ALTERA, ARRIA, CYCLONE, HARDCOPY, MAX, MEGACORE, NIOS, QUARTUS and STRATIX are Reg. U.S. Pat. & Tm. Off.
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Nios II Processor Reference Handbook
February 2014
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参数描述
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IPOD TOUCH4-C-B 制造商:Distributed By MCM 功能描述:Apple® iPod Black Touch 4th Gen Digitizer + Glass 制造商:Distributed By MCM 功能描述:APPLE IPOD TOUCH DIGITIZER BLACK
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IPP015N04N G 功能描述:MOSFET OptiMOS 3 PWR TRANST 40V 120A RoHS:否 制造商:STMicroelectronics 晶体管极性:N-Channel 汲极/源极击穿电压:650 V 闸/源击穿电压:25 V 漏极连续电流:130 A 电阻汲极/源极 RDS(导通):0.014 Ohms 配置:Single 最大工作温度: 安装风格:Through Hole 封装 / 箱体:Max247 封装:Tube
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