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参数资料
| 型号： | ISL8102EVAL1 |
| 厂商： | Intersil |
| 文件页数： | 27/27页 |
| 文件大小： | 0K |
| 描述： | EVAL BOARD 1 FOR ISL8102 |
| 标准包装： | 1 |
| 系列： | * |
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ISL8102
Package Outline Drawing
L32.5x5
32 LEAD QUAD FLAT NO-LEAD PLASTIC PACKAGE
Rev 2, 02/07
4X 3.5
5.00
A
B
25
28X 0.50
32
6
PIN #1 INDEX AREA
6
PIN 1
INDEX AREA
(4X)
0.15
24
17
1
8
3 .10 ± 0 . 15
TOP VIEW
16
9
32X 0.40 ± 0.10
BOTTOM VIEW
0.10 M C A B
+ 0.07
4 32X 0.23 - 0.05
SEE DETAIL "X"
0 . 90 ± 0.1
0.10 C
C
BASE PLANE
SEATING PLANE
( 4. 80 TYP )
(
3. 10 )
( 28X 0 . 5 )
SIDE VIEW
0.08 C
C
0 . 2 REF
5
(32X 0 . 23 )
0 . 00 MIN.
0 . 05 MAX.
( 32X 0 . 60)
NOTES:
DETAIL "X"
1. Dimensions are in millimeters.
Dimensions in ( ) for Reference Only.
TYPICAL RECOMMENDED LAND PATTERN
2. Dimensioning and tolerancing conform to AMSE Y14.5m-1994.
3. Unless otherwise specified, tolerance : Decimal ± 0.05
4. Dimension b applies to the metallized terminal and is measured
between 0.15mm and 0.30mm from the terminal tip.
5. Tiebar shown (if present) is a non-functional feature.
6. The configuration of the pin #1 identifier is optional, but must be
located within the zone indicated. The pin #1 identifier may be
either a mold or mark feature.
All Intersil U.S. products are manufactured, assembled and tested utilizing ISO9000 quality systems.
Intersil Corporation’s quality certifications can be viewed at www.intersil.com/design/quality
Intersil products are sold by description only. Intersil Corporation reserves the right to make changes in circuit design, software and/or specifications at any time without
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reliable. However, no responsibility is assumed by Intersil or its subsidiaries for its use; nor for any infringements of patents or other rights of third parties which may result
from its use. No license is granted by implication or otherwise under any patent or patent rights of Intersil or its subsidiaries.
For information regarding Intersil Corporation and its products, see www.intersil.com
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FN9247.1
July 28, 2008
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