参数资料
| 型号： | ISLA118P50IRZ |
| 厂商： | Intersil |
| 文件页数： | 29/34页 |
| 文件大小： | 0K |
| 描述： | IC ADC 8BIT SPI/SRL 500M 72QFN |
| 产品培训模块： | Solutions for Test and Measurement Equipment |
| 标准包装： | 1 |
| 系列： | FemtoCharge™ |
| 位数： | 8 |
| 采样率（每秒）： | 500M |
| 数据接口： | 串行，SPI? |
| 转换器数目： | 2 |
| 功率耗散（最大）： | 477mW |
| 电压电源： | 模拟和数字 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 72-VFQFN 裸露焊盘 |
| 供应商设备封装： | 72-QFN（10x10） |
| 包装： | 托盘 |
| 输入数目和类型： | 2 个单端，单极；1 个差分，单极 |
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ISLA118P50
4
FN7565.2
July 25, 2011
Pin Descriptions
PIN NUMBER
LVDS [LVCMOS] NAME
LVDS [LVCMOS] FUNCTION
1, 6, 12, 19, 24, 71
AVDD
1.8V Analog Supply
2, 5, 13, 14, 16, 17, 18, 30,
31, 32, 33, 34, 35, 37, 38, 39,
40
DNC
Do Not Connect
3, 4
RES
Reserved. (4.7k
Ω pull-up to OVDD is required for each of these pins)
7, 8, 11, 72
AVSS
Analog Ground
9, 10
VINN, VINP
Analog Input Negative, Positive
15
VCM
Common Mode Output
20, 21
CLKP, CLKN
Clock Input True, Complement
22
OUTMODE
Tri-Level Output Mode (LVDS, LVCMOS)
23
NAPSLP
Tri-Level Power Control (Nap, Sleep modes)
25
RESETN
Power On Reset (Active Low)
26, 45, 55, 65
OVSS
Output Ground
27, 36, 56
OVDD
1.8V Output Supply
28, 29
CLKDIVRSTP,
CLKDIVRSTN
Sample Clock Synchronous Divider Reset Positive, Negative
41, 42
D0N, D0P [NC, D0]
LVDS Bit 0 Output Complement, True [NC, LVCMOS Bit 0]
43, 44
D1N, D1P [NC, D1]
LVDS Bit 1 Output Complement, True [NC, LVCMOS Bit 1]
46
RLVDS
LVDS Bias Resistor (connect to OVSS with a 10k
Ω, 1% resistor)
47, 48
CLKOUTN, CLKOUTP [NC,
CLKOUT]
LVDS Clock Output Complement, True [NC, LVCMOS CLKOUT]
49, 50
D2N, D2P [NC, D2]
LVDS Bit 2 Output Complement, True [NC, LVCMOS Bit 2]
51, 52
D3N, D3P [NC, D3]
LVDS Bit 3 Output Complement, True [NC, LVCMOS Bit 3]
53, 54
D4N, D4P [NC, D4]
LVDS Bit 4 Output Complement, True [NC, LVCMOS Bit 4]
57, 58
D5N, D5P [NC, D5]
LVDS Bit 5 Output Complement, True [NC, LVCMOS Bit 5]
59, 60
D6N, D6P [NC, D6]
LVDS Bit 6 Output Complement, True [NC, LVCMOS Bit 6]
61, 62
D7N, D7P [NC, D7]
LVDS Bit 7 (MSB) Output Complement, True [NC, LVCMOS Bit 7]
63, 64
ORN, ORP [NC, OR]
LVDS Over Range Complement, True [NC, LVCMOS Over Range]
66
SDO
SPI Serial Data Output (4.7k
Ω pull-up to OVDD is required)
67
CSB
SPI Chip Select (active low)
68
SCLK
SPI Clock
69
SDIO
SPI Serial Data Input/Output
70
OUTFMT
Tri-Level Output Data Format (Two’s Comp., Gray Code, Offset Binary)
PD
AVSS
Exposed Paddle - Analog Ground
NOTE: LVCMOS Output Mode Functionality is shown in brackets (NC = No Connection)
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PDF描述 |
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