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参数资料
| 型号： | ISPPAC-POWR604-01TN44I |
| 厂商： | Lattice Semiconductor Corporation |
| 文件页数： | 4/30页 |
| 文件大小： | 0K |
| 描述： | IC ISP POWER MGR ANLG/LOG 44TQFP |
| 标准包装： | 160 |
| 系列： | ispPAC® |
| 应用： | 电源监控器，序列发生器 |
| 输入电压： | 0 V ~ 6 V |
| 电源电压： | 2.25 V ~ 5.5 V |
| 电流 - 电源： | 10mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 44-LQFP |
| 供应商设备封装： | 44-TQFP（10x10） |
| 包装： | 托盘 |
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Lattice Semiconductor
Pin Descriptions
ispPAC-POWR604 Data Sheet
VDDINP
2.25V-5.5V
OUT7
2.25V-5.5V
OUT8
2.25V-5.5V
2.25V-5.5V
2.25V-5.5V
0V-5.72V
0V-5.72V
0V-5.72V
Number
1
2
3
4
5
6
7
8
9
10
11
12
13
14
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29
30
31
32
33
34
35
36
37
38
39
40
41
Name
NC
NC
NC
NC
VDD
IN1
IN2
IN3
IN4
RESET
VDDINP
OUT5 8
OUT6 8
8
8
NC
NC
COMP6
COMP5
COMP4
COMP3
COMP2
COMP1
TCK
POR
CLK
GND
TDO
TRST
TDI
TMS
VMON1
VMON2
VMON3
VMON4
VMON5
VMON6
NC
CREF
NC
NC
Pin Type
—
—
—
—
Power
CMOS Input
CMOS Input
CMOS Input
CMOS Input
CMOS input
Power
O/D Output
O/D Output
O/D Output
O/D Output
—
—
O/D Output
O/D Output
O/D Output
O/D Output
O/D Output
O/D Output
TTL/LVCMOS Input
O/D Output
Bi-directional I/O
Ground
TTL/LVCMOS Output
TTL/LVCMOS Input
TTL/LVCMOS Input
TTL/LVCMOS Input
Analog Input
Analog Input
Analog Input
Analog Input
Analog Input
Analog Input
—
Reference
—
—
Voltage Range
—
—
—
—
2.25V-5.5V
VDDINP 1, 3
VDDINP 1, 3
VDDINP 1, 3
1, 3
VDD 6
3
2.25V-5.5V 2
2.25V-5.5V 2
2
2.25V-5.5V 2
—
—
2.25V-5.5V 2
2
2.25V-5.5V 2
2
2.25V-5.5V 2
2
VDD
2.25V-5.5V
VDD 2, 5
VDD
VDD
VDD
VDD
0V-5.72V 4
4
0V-5.72V 4
4
0V-5.72V 4
4
—
1.17V 7
—
—
Description
No Connect
No Connect
No Connect
No Connect
Main Power Supply
Input 1
Input 2
Input 3
Input 4
PLD Reset Input, Active Low
Digital Inputs Power Supply
Open-Drain Output
Open-Drain Output
Open-Drain Output
Open-Drain Output
No Connect
No Connect
VMON6 Comparator Output (Open-Drain)
VMON5 Comparator Output (Open-Drain)
VMON4 Comparator Output (Open-Drain)
VMON3 Comparator Output (Open-Drain)
VMON2 Comparator Output (Open-Drain)
VMON1 Comparator Output (Open-Drain)
Test Clock (JTAG Pin)
Power-On-Reset Output
Clock Output (Open-Drain) or Clock Input
Ground
Test Data Out (JTAG Pin)
Test Reset, Active Low, 50k Ohm Internal Pull-up
(JTAG Pin, Optional Use)
Test Data In, 50k Ohm Pull-up (JTAG Pin)
Test Mode Select, 50k Ohm Internal Pull-up (JTAG
Pin)
Voltage Monitor Input 1
Voltage Monitor Input 2
Voltage Monitor Input 3
Voltage Monitor Input 4
Voltage Monitor Input 5
Voltage Monitor Input 6
No Connect
Reference for Internal Use, Decoupling Capacitor
(.1uf Required, CREF to GND)
No Connect
No Connect
2-3
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