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参数资料
| 型号： | KSZ8841-16MQL |
| 厂商： | Micrel Inc |
| 文件页数： | 21/105页 |
| 文件大小： | 0K |
| 描述： | IC MAC CTRLR 8/16BIT 128-PQFP |
| 标准包装： | 66 |
| 控制器类型： | 以太网控制器，MAC |
| 接口： | 总线 |
| 电源电压： | 3.1 V ~ 3.5 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 128-BFQFP |
| 供应商设备封装： | 128-PQFP（14x20） |
| 包装： | 托盘 |
| 产品目录页面： | 1080 (CN2011-ZH PDF) |
| 配用： | 576-1631-ND - BOARD EVALUATION KSZ8841-16MQL |
| 其它名称： | 576-2112 KSZ8841-16MQL-ND |
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Micrel, Inc.
KSZ8841-16/32 MQL/MVL/MBL
October 2007
22
M9999-102207-1.6
Pin Description for KSZ8841-32 Chip (32-Bit)
Pin Number
Pin Name
Type
Pin Function
1
TEST_EN
I
Test Enable
For normal operation, pull-down this pin-to-ground.
2
SCAN_EN
I
Scan Test Scan Mux Enable
For normal operation, pull-down this pin-to-ground.
3
P1LED2
Opu
4
P1LED1
Opu
5
P1LED0
Opu
Port 1 LED indicators
1 defined as follows:
Chip Global Control Register: CGCR
bit [15,9]
[0,0] Default
[0,1]
P1LED3
2
—
P1LED2
Link/Act
100Link/Act
P1LED1
Full duplex/Col
10Link/Act
P1LED0
Speed
Full duplex
Reg. CGCR bit [15,9]
[1,0]
[1,1]
P1LED3
2
Act
—
P1LED2
Link
—
P1LED1
Full duplex/Col
—
P1LED0
Speed
—
Notes:
1. Link = On; Activity = Blink; Link/Act = On/Blink; Full Dup/Col = On/Blink;
Full Duplex = On (Full duplex); Off (Half duplex)
Speed = On (100BASE-T); Off (10BASE-T)
2. P1LED3 is pin 27.
6
NC
Opu
No Connect.
7
NC
Opu
No Connect.
8
NC
Opu
No Connect.
9
DGND
Gnd
Digital ground
10
VDDIO
P
3.3V digital VDDIO input power supply for IO with well decoupling capacitors.
11
RDYRTNN
Ipd
Ready Return Not:
For VLBus-like mode: Asserted by the host to complete synchronous read cycles. If the
host doesn’t connect to this pin, assert this pin.
For burst mode (32-bit interface only): Host drives this pin low to signal waiting states.
12
BCLK
Ipd
Bus Interface Clock
Local bus clock for synchronous bus systems. Maximum frequency is 50MHz.
This pin should be tied Low or unconnected if it is in asynchronous mode.
13
DATACSN
Ipu
DATA Chip Select Not (For KSZ8841-32 Mode only)
Chip select signal for QMU data register (QDRH, QDRL), active Low.
When DATACSN is Low, the data path can be accessed regardless of the value of AEN,
A15-A1, and the content of the BANK select register.
14
PMEN
Opu
Power Management Event Not
When asserted (Low), this signal indicates that a power management event has occurred
in the system when a wake-up signal is detected by KSZ8841M.
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